JP2002325194A - デジタルカメラ - Google Patents
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Abstract
(57)【要約】
【解決手段】 デジタルイメージを取得するためのデジ
タルカメラであって、当該カメラ内部への複数の制御信
号を生成するオペレータ制御部と、前記制御信号の外部
制御を可能とするとともに、前記デジタルカメラ外部の
装置へ前記デジタルイメージを送信するデジタル入出力
インタフェースと、を有する。
タルカメラであって、当該カメラ内部への複数の制御信
号を生成するオペレータ制御部と、前記制御信号の外部
制御を可能とするとともに、前記デジタルカメラ外部の
装置へ前記デジタルイメージを送信するデジタル入出力
インタフェースと、を有する。
Description
【０００１】
【発明の属する技術分野】本発明は電子静止イメージビ
デオカメラに関し、特に物体や情景の静止画を保管する
ために、イメージカラー情報を記録するパーソナルコン
ピュータ（ＰＣ）コンパチブルなフォーマットに構成し
ＰＣコンパチブルな記録デイスケットに格納する、例え
ばＪＰＥＧ（Ｊｏｉｎｔ Ｐｈｏｔｏｇｒａｐｉｃ Ｅ
ｘｐｅｒｔｓ Ｇｒｏｕｐ）アルゴリズム・スタンダー
ドのような圧縮／伸長アルゴリズムを用いて、オペレー
タが選択可能な圧縮デジタル信号フォーマットに変換す
る改良型電子静止イメージビデオカメラに関する。例え
ば、そのデイスケットは３．５（３ １／２）インチの
デジタルデイスケットでもよい。そのデジタルデイスケ
ットは電子カメラから取り外し可能であり、前もってロ
ードされた対応する伸長アルゴリズムを持つＰＣに直接
挿入することができる。従って、デジタルイメージはワ
ードプロセシング、デイスクトップパブリシング、デー
タベース、マルチメデイアの応用に直接利用できるよう
フォーマット・コンパチブルとなっている。
デオカメラに関し、特に物体や情景の静止画を保管する
ために、イメージカラー情報を記録するパーソナルコン
ピュータ（ＰＣ）コンパチブルなフォーマットに構成し
ＰＣコンパチブルな記録デイスケットに格納する、例え
ばＪＰＥＧ（Ｊｏｉｎｔ Ｐｈｏｔｏｇｒａｐｉｃ Ｅ
ｘｐｅｒｔｓ Ｇｒｏｕｐ）アルゴリズム・スタンダー
ドのような圧縮／伸長アルゴリズムを用いて、オペレー
タが選択可能な圧縮デジタル信号フォーマットに変換す
る改良型電子静止イメージビデオカメラに関する。例え
ば、そのデイスケットは３．５（３ １／２）インチの
デジタルデイスケットでもよい。そのデジタルデイスケ
ットは電子カメラから取り外し可能であり、前もってロ
ードされた対応する伸長アルゴリズムを持つＰＣに直接
挿入することができる。従って、デジタルイメージはワ
ードプロセシング、デイスクトップパブリシング、デー
タベース、マルチメデイアの応用に直接利用できるよう
フォーマット・コンパチブルとなっている。
【０００２】
【従来の技術】図１は従来の電子静止イメージカメラ系
のブロック図である。ここでは、シャッター制御回路２
ａが起動すると、ＣＣＤイメージセンサ要素１ａは物体
の静止イメージをアナログ・カラービデオ信号に変換す
る。イメージセンサ要素の出力カラービデオ信号はそれ
から信号処理サブシステム３ａに送られ、ＮＴＳＣ（Ｎ
ａｔｉｏｎａｌ Ｔｅｌｅｌｅｖｉｓｉｏｎ Ｓｙｓｔ
ｅｍ Ｃｏｍｍｉｔｔｅｅ）や他のコンポジット・ビデ
オ・フォーマット（ＰＡＬ〔ＥｕｒｏｐｅａｎＶｉｄｅ
ｏ ｓｔａｎｄａｒｄ Ｐｈａｓｅ Ａｌｔｅｒｎａｔ
ｉｎｇ Ｌｉｎｅ〕のような）に変換され、アナログ・
ビデオ・フロッピー（登録商標）デイスクや電気的消去
可能プログラマブル読出し専用メモリ（ＥＥＰＲＯＭ）
やアナログ・オーデイオ・カセットやバブルメモリやそ
の他の記録装置５ａのような大容量記憶装置にアナログ
フォーマットで記録される。電力は再充電可能／取り外
し可能バッテリ・システム４ａによって供給される。イ
メージを電子イメージ信号に変換し記憶装置に転送する
電子カメラは、米国特許４１３１９１９と米国特許４４
５６９３１と米国特許４７５８８８３と米国特許４８０
３５５４と米国特許４８３７６２８で開示されている。
のブロック図である。ここでは、シャッター制御回路２
ａが起動すると、ＣＣＤイメージセンサ要素１ａは物体
の静止イメージをアナログ・カラービデオ信号に変換す
る。イメージセンサ要素の出力カラービデオ信号はそれ
から信号処理サブシステム３ａに送られ、ＮＴＳＣ（Ｎ
ａｔｉｏｎａｌ Ｔｅｌｅｌｅｖｉｓｉｏｎ Ｓｙｓｔ
ｅｍ Ｃｏｍｍｉｔｔｅｅ）や他のコンポジット・ビデ
オ・フォーマット（ＰＡＬ〔ＥｕｒｏｐｅａｎＶｉｄｅ
ｏ ｓｔａｎｄａｒｄ Ｐｈａｓｅ Ａｌｔｅｒｎａｔ
ｉｎｇ Ｌｉｎｅ〕のような）に変換され、アナログ・
ビデオ・フロッピー（登録商標）デイスクや電気的消去
可能プログラマブル読出し専用メモリ（ＥＥＰＲＯＭ）
やアナログ・オーデイオ・カセットやバブルメモリやそ
の他の記録装置５ａのような大容量記憶装置にアナログ
フォーマットで記録される。電力は再充電可能／取り外
し可能バッテリ・システム４ａによって供給される。イ
メージを電子イメージ信号に変換し記憶装置に転送する
電子カメラは、米国特許４１３１９１９と米国特許４４
５６９３１と米国特許４７５８８８３と米国特許４８０
３５５４と米国特許４８３７６２８で開示されている。
【０００３】従来の電子静止イメージカメラ、例えば前
記米国特許で開示されている型のものは、テレビジョン
やビデオモニタへの表示を容易にするＮＴＳＣ（Ｎａｔ
ｉｏｎａｌ Ｔｅｌｅｌｅｖｉｓｉｏｎ Ｓｙｓｔｅｍ
Ｃｏｍｍｉｔｔｅｅ）や磁気／電子記憶媒体上での類
似するアナログフォーマットで所望のイメージに対応す
る電子的信号を生成する。現在の技術レベルでは、ＰＣ
のソフトウエア・アプリケーションで直接アナログイメ
ージを等価なデジタルフォーマットに変換することは高
価となり、かつ時間がかかる。現在、電子静止イメージ
カメラで得られたイメージをＰＣコンパチブル・フォー
マットするために、まずその信号をコンポジットＮＴＳ
ＣかＲＧＢビデオ信号に変換する必要があり、アップス
社（Ａａｐｐｓ Ｃｏｒｐｏｒａｔｉｏｎ）とオレンジ
マイクロ社（Ｏｒａｎｇｅ Ｍｉｃｒｏ）とラスターオ
プス社（Ｒａｓｔｅｒ Ｏｐｓ）とその他の会社から商
業的に販売されている型の"フレームグラバー"（ＰＣに
インストールされたデジタル回路ボードであり、ビデオ
イメージをＰＣコンパチブル・フォーマットへ変換する
ものである）のような変換デバイスを使って行うか、ま
たはそのイメージをハードコピー・プリント（写真）に
変換し、ＰＣに接続する装置の一部である電子スキャナ
ーを利用してイメージをデジタルフォーマットに変換す
る方法がある。後者の技術はデイスクトップパブリッシ
ング業界で広く使われている。
記米国特許で開示されている型のものは、テレビジョン
やビデオモニタへの表示を容易にするＮＴＳＣ（Ｎａｔ
ｉｏｎａｌ Ｔｅｌｅｌｅｖｉｓｉｏｎ Ｓｙｓｔｅｍ
Ｃｏｍｍｉｔｔｅｅ）や磁気／電子記憶媒体上での類
似するアナログフォーマットで所望のイメージに対応す
る電子的信号を生成する。現在の技術レベルでは、ＰＣ
のソフトウエア・アプリケーションで直接アナログイメ
ージを等価なデジタルフォーマットに変換することは高
価となり、かつ時間がかかる。現在、電子静止イメージ
カメラで得られたイメージをＰＣコンパチブル・フォー
マットするために、まずその信号をコンポジットＮＴＳ
ＣかＲＧＢビデオ信号に変換する必要があり、アップス
社（Ａａｐｐｓ Ｃｏｒｐｏｒａｔｉｏｎ）とオレンジ
マイクロ社（Ｏｒａｎｇｅ Ｍｉｃｒｏ）とラスターオ
プス社（Ｒａｓｔｅｒ Ｏｐｓ）とその他の会社から商
業的に販売されている型の"フレームグラバー"（ＰＣに
インストールされたデジタル回路ボードであり、ビデオ
イメージをＰＣコンパチブル・フォーマットへ変換する
ものである）のような変換デバイスを使って行うか、ま
たはそのイメージをハードコピー・プリント（写真）に
変換し、ＰＣに接続する装置の一部である電子スキャナ
ーを利用してイメージをデジタルフォーマットに変換す
る方法がある。後者の技術はデイスクトップパブリッシ
ング業界で広く使われている。
【０００４】
【発明が解決しようとする課題】本発明の目的は、パー
ソナルコンピュータに共通である標準着脱可能な磁気デ
イスケットに再記録できる多数のデジタルデータフォー
マットからオペレータが選択した１つのデータフォーマ
ットを用いて、オペレータの選択した画像圧縮を行うこ
とができる改良型静止イメージカメラを提供することで
ある。
ソナルコンピュータに共通である標準着脱可能な磁気デ
イスケットに再記録できる多数のデジタルデータフォー
マットからオペレータが選択した１つのデータフォーマ
ットを用いて、オペレータの選択した画像圧縮を行うこ
とができる改良型静止イメージカメラを提供することで
ある。
【０００５】本発明の目的はさらに、ＰＣ上でのポピュ
ラーなワードプロセシングとデイスクトップパブリシン
グとその他ソフトウエアプログラムに即時、かつ直接組
み込めるデジタル・イメージ・ファイルを備える改良型
静止イメージカメラを提供することにある。
ラーなワードプロセシングとデイスクトップパブリシン
グとその他ソフトウエアプログラムに即時、かつ直接組
み込めるデジタル・イメージ・ファイルを備える改良型
静止イメージカメラを提供することにある。
【０００６】本発明の他の目的は、ユーザの選択下で、
ＰＣに直接挿入できるデジタルメモリ記憶デバイスへ選
択的に圧縮された静止画を、カラーか白黒のフォーマッ
トで記録し、そして格納できる改良型静止イメージカメ
ラを提供することにある。ここで、これらのフォーマッ
トはデジタルメモリ記憶デバイスへ各イメージフレーム
付きで格納されるカラー／白黒モード選択と同様に、オ
ペレータによって選択された圧縮の程度を示す信号フラ
グ付きの非常に多くのイメージを、デジタル値として容
易に記憶させることができる。
ＰＣに直接挿入できるデジタルメモリ記憶デバイスへ選
択的に圧縮された静止画を、カラーか白黒のフォーマッ
トで記録し、そして格納できる改良型静止イメージカメ
ラを提供することにある。ここで、これらのフォーマッ
トはデジタルメモリ記憶デバイスへ各イメージフレーム
付きで格納されるカラー／白黒モード選択と同様に、オ
ペレータによって選択された圧縮の程度を示す信号フラ
グ付きの非常に多くのイメージを、デジタル値として容
易に記憶させることができる。
【０００７】本発明の目的はさらに、一つのイメージと
同様に連続したイメージを自動的にすばやく獲得できる
改良型静止イメージカメラを提供することにある。
同様に連続したイメージを自動的にすばやく獲得できる
改良型静止イメージカメラを提供することにある。
【０００８】また、このカメラはイメージのモニターと
表示のためのビデオ・フォーマットとデジタル・フォー
マットの両方での多重出力を提供することで、データ伝
送と付加的処理、すなわち多様な記憶媒体への格納を容
易にしている。
表示のためのビデオ・フォーマットとデジタル・フォー
マットの両方での多重出力を提供することで、データ伝
送と付加的処理、すなわち多様な記憶媒体への格納を容
易にしている。
【０００９】本発明のさらに他の目的は、アナログやデ
ジタルまたは無線周波数（ＲＦ）による制御信号によっ
て、直接あるいは間接的に制御できる電荷結合素子（Ｃ
ＣＤ）と赤外線センサ（ＩＲ）と紫外線センサ（ＵＶ）
を含む多様な光電センサを利用した電子シャッターと露
出制御によってカラーか白黒のどちらかで、またオペレ
ータが選択可能な高・中・低のいずれかの解像度で静止
画を取ることができる、より効率の良い電子静止イメー
ジカメラを提供することにある。
ジタルまたは無線周波数（ＲＦ）による制御信号によっ
て、直接あるいは間接的に制御できる電荷結合素子（Ｃ
ＣＤ）と赤外線センサ（ＩＲ）と紫外線センサ（ＵＶ）
を含む多様な光電センサを利用した電子シャッターと露
出制御によってカラーか白黒のどちらかで、またオペレ
ータが選択可能な高・中・低のいずれかの解像度で静止
画を取ることができる、より効率の良い電子静止イメー
ジカメラを提供することにある。
【００１０】本発明のさらに進んだ目的は、アナログ・
コンポジットビデオ・フォーマットの電子静止イメージ
をＰＣで読出せるデジタルデータ・フォーマットへ効率
的に変換するプログラマブルなビデオ・イメージ変換装
置を提供することにある。
コンポジットビデオ・フォーマットの電子静止イメージ
をＰＣで読出せるデジタルデータ・フォーマットへ効率
的に変換するプログラマブルなビデオ・イメージ変換装
置を提供することにある。
【００１１】この変換装置はまた、ビデオ・イメージを
獲得しモニタとデイスプレイ上でビデオ・イメージをモ
ニターするために追加されたビデオ入力・出力を提供
し、そして、シリアルやパラレル等のような様々なフォ
ーマットで多様な出力を行うＩ／Ｏ線をとうして圧縮デ
ジタル・イメージ・データか未処理のデジタル・イメー
ジ・データかのどちらかを転送できる。また、本発明は
追加のインターフェイス回路と音声デジタイザを通じて
イメージ付きの音響／音声をも組み込むことができる。
獲得しモニタとデイスプレイ上でビデオ・イメージをモ
ニターするために追加されたビデオ入力・出力を提供
し、そして、シリアルやパラレル等のような様々なフォ
ーマットで多様な出力を行うＩ／Ｏ線をとうして圧縮デ
ジタル・イメージ・データか未処理のデジタル・イメー
ジ・データかのどちらかを転送できる。また、本発明は
追加のインターフェイス回路と音声デジタイザを通じて
イメージ付きの音響／音声をも組み込むことができる。
【００１２】最後に、本発明の目的は、効率的な設計
で、携帯型の操作をより長時間行うことができ、連続的
な内部自己テスト・ソフトウエア・ルーチンとオペレー
タ・デイスプレイを使って、ユーザに操作上のステータ
スを供給する電子静止イメージ・カメラを提供すること
である。
で、携帯型の操作をより長時間行うことができ、連続的
な内部自己テスト・ソフトウエア・ルーチンとオペレー
タ・デイスプレイを使って、ユーザに操作上のステータ
スを供給する電子静止イメージ・カメラを提供すること
である。
【００１３】
【課題を解決するための手段】この目的を達成する本発
明は、デジタルイメージを取得するためのデジタルカメ
ラであって、当該カメラ内部への複数の制御信号を生成
するオペレータ制御部と、前記制御信号の外部制御を可
能とするとともに、前記デジタルカメラ外部の装置へ前
記デジタルイメージを送信するデジタル入出力インタフ
ェースと、を有することを特徴とする。
明は、デジタルイメージを取得するためのデジタルカメ
ラであって、当該カメラ内部への複数の制御信号を生成
するオペレータ制御部と、前記制御信号の外部制御を可
能とするとともに、前記デジタルカメラ外部の装置へ前
記デジタルイメージを送信するデジタル入出力インタフ
ェースと、を有することを特徴とする。
【００１４】
【発明の実施の形態】図２（ｂ）は、本発明の原理に対
応する電子静止カメラの好適な一実施例の設計ブロック
図である。図２（ｂ）を参照して、イメージ・光学撮像
要素１は例えば電荷結合素子（ＣＣＤ）（あるいは赤外
線（ＩＲ）や紫外線（ＵＶ）センサ）であり、映像"シ
ュート"コマンドが制御パネル２にオペレータによって
与えられた時、物体の静止イメージを電気信号に変換す
る。写真を取るとき、焦点合わせとシャッタ・スピード
がレンズ系とデジタル制御部９の制御下でのシャッタ・
スピード選択機構によって制御される。
応する電子静止カメラの好適な一実施例の設計ブロック
図である。図２（ｂ）を参照して、イメージ・光学撮像
要素１は例えば電荷結合素子（ＣＣＤ）（あるいは赤外
線（ＩＲ）や紫外線（ＵＶ）センサ）であり、映像"シ
ュート"コマンドが制御パネル２にオペレータによって
与えられた時、物体の静止イメージを電気信号に変換す
る。写真を取るとき、焦点合わせとシャッタ・スピード
がレンズ系とデジタル制御部９の制御下でのシャッタ・
スピード選択機構によって制御される。
【００１５】"シュート"制御６が半分押される（図６
（ｄ）参照）時、電源電圧は再充電可能電池４から、電
子回路とデジタル制御部９、制御パネル２とデイスクド
ライブ・アセンブリ５へ供給される。不図示の露出制御
回路は、基準クロックタイミングの制御下のフィールド
・シフトパルスと、ＣＣＤデバイスと前処理回路を駆動
するデジタル制御部９によって供給される制御信号と同
様に、適切な水平／垂直転送パルスを生成する。この設
計は、例えば特許４１３１９１９と、特許４４５６９３
１と、従来技術として周知の類似の設計で引用されてい
る技術の中で、よく知られているものである。
（ｄ）参照）時、電源電圧は再充電可能電池４から、電
子回路とデジタル制御部９、制御パネル２とデイスクド
ライブ・アセンブリ５へ供給される。不図示の露出制御
回路は、基準クロックタイミングの制御下のフィールド
・シフトパルスと、ＣＣＤデバイスと前処理回路を駆動
するデジタル制御部９によって供給される制御信号と同
様に、適切な水平／垂直転送パルスを生成する。この設
計は、例えば特許４１３１９１９と、特許４４５６９３
１と、従来技術として周知の類似の設計で引用されてい
る技術の中で、よく知られているものである。
【００１６】カメラの遠隔操作を行う本発明での別の実
施例を図６（ｃ）に示す。遠隔"シュート"制御３０が、
例えば手動によるか可視光か電子エネルギーによる手段
によって駆動される時、制御信号が生成され、カメラ本
体の外側に置かれる外部ジャック３１を通じて送り出さ
れる。外部制御３０は、その技術に精通している人には
よく知られているツイストペア線ケーブルによって電気
的に外部ジャック３１と接続されている。外部的に生成
された"シュート・コマンド"を受信すると、リレースイ
ッチ３２が駆動され内部スイッチが閉じられる。スイッ
チ３２が閉じると、前述したプロセスが開始し、前述の
Ｖ＋ボルトの半分の電圧が供給される。フル電圧Ｖ＋は
固定遅延３３を経由して供給される。ここで、その電圧
値は、イメージデータを受信する前に、デイスケット・
ドライブアセンブリ５（図２（ｂ））と関連する制御回
路を初期化させるために選ばれている。
施例を図６（ｃ）に示す。遠隔"シュート"制御３０が、
例えば手動によるか可視光か電子エネルギーによる手段
によって駆動される時、制御信号が生成され、カメラ本
体の外側に置かれる外部ジャック３１を通じて送り出さ
れる。外部制御３０は、その技術に精通している人には
よく知られているツイストペア線ケーブルによって電気
的に外部ジャック３１と接続されている。外部的に生成
された"シュート・コマンド"を受信すると、リレースイ
ッチ３２が駆動され内部スイッチが閉じられる。スイッ
チ３２が閉じると、前述したプロセスが開始し、前述の
Ｖ＋ボルトの半分の電圧が供給される。フル電圧Ｖ＋は
固定遅延３３を経由して供給される。ここで、その電圧
値は、イメージデータを受信する前に、デイスケット・
ドライブアセンブリ５（図２（ｂ））と関連する制御回
路を初期化させるために選ばれている。
【００１７】いずれかの実施例で、"シュート"制御が完
全に押される時、シャッタ制御１５（図６（ｄ））はシ
ャッターパルスを生成する。そして、生成されたそのシ
ャッターパルスはＡ／Ｄ変換器８に対する制御信号を生
成する。そして、Ａ／Ｄ変換器８は、ピクセル・マルチ
プレクサ７のサンプル＆ホールド回路中のイメージ／写
真データ信号をデジタル信号に変換する。技術的によく
知られた制御命令とアドレス命令はデジタル制御部９か
ら生成され、ピクセルバッファ１０とフレームバッファ
１１にデジタルイメージデータを記憶させる。イメージ
変換が終了すると、フレームバッファの内容は圧縮プロ
セッサ１２へ転送される。ここで、圧縮プロセッサ１２
は、例えばシーキューブ社（Ｃ−Ｃｕｂｅ）（サンノ
ゼ、カルフォルニア）の４チップＡＳＩＣ（Ａｐｐｒｉ
ｃａｔｉｏｎ ＳｐｅｃｉｆｉｃＩｎｔｅｇｒａｔｅｄ
Ｃｉｒｃｕｉｔ）セットのような、現在商業的に提供
されている多くのバージョンでもよい。ＪＰＥＧ（Ｊｏ
ｉｎｔ Ｐｈｏｔｏｇｒａｈｉｃ Ｅｘｐｅｒｔｓ Ｇ
ｒｏｕｐ）、すなわちＣＣＩＴＴ（Ｉｎｔｅｒｎａｔｉ
ｏｎａｌ Ｔｅｌｅｇｒａｐｈ ａｎｄ Ｔｅｌｅｐｈ
ｏｎｅ Ｃｏｍｍｉｔｔｅｅ）のサブセットであるＩＳ
Ｏ（Ｉｎｔｅｒｎａｔｉｏｎａｌ Ｓｔａｎｄａｒｄｓ
Ｏｒｇａｎｉｚａｔｉｏｎ）の一部会であり、ここで
まとめられたイメージ圧縮アルゴリズムが、１９８５年
の報告書ＪＴＣ１／ＳＣ２／ＷＧ８で完全に記述されて
いる。圧縮プロセッサ１２では、このイメージ圧縮アル
ゴリズムをデジタル制御部９の制御下で実行しイメージ
のサイズを圧縮する。５０：１まで選択できる多様な圧
縮率はデジタル・イメージフレーム上で実行される。他
の圧縮率は制御パネル２のスイッチ１４Ａと１４Ｂ（図
６（ｄ））を使って、オペレータが選択可能である。そ
れから、制御パネル２のユーザ・スイッチ１７（図６
（ｄ））に対してオペレータが選択した設定によって、
圧縮されたデジタルフレームはＩＢＭ ＰＣ／そのクロ
ーン機（ＧＩＦＦのような）かアップル・マッキントッ
シュ（Ａｐｐｌｅ Ｍａｃｉｎｔｏｓｈ）（ＰＩＣＴII
のような）のいずれかのイメージ・ファイルフォーマッ
トに変換される。そのフォーマット変換が終わると、そ
のファイルは、デジタル制御部９のコマンド下で高密度
（１．４Ｍバイト記憶容量）デイスクドライブ・ユニッ
ト５を制御するデイスク入出力（Ｉ／Ｏ）インターフェ
イス回路１３の一時記憶バッファに書かれる。デイスケ
ット等へのファイル転送に続いて、制御パネル２のフレ
ームカウンタ・デイスプレイ２２は適切な制御信号によ
って修正される。そして、カメラは次のイメージに対す
る同じ処理を行うことが可能となる。電子回路とデイス
クドライブ系に対する電力は、次に"シュート"制御スイ
ッチ６を解放することによって止められる。
全に押される時、シャッタ制御１５（図６（ｄ））はシ
ャッターパルスを生成する。そして、生成されたそのシ
ャッターパルスはＡ／Ｄ変換器８に対する制御信号を生
成する。そして、Ａ／Ｄ変換器８は、ピクセル・マルチ
プレクサ７のサンプル＆ホールド回路中のイメージ／写
真データ信号をデジタル信号に変換する。技術的によく
知られた制御命令とアドレス命令はデジタル制御部９か
ら生成され、ピクセルバッファ１０とフレームバッファ
１１にデジタルイメージデータを記憶させる。イメージ
変換が終了すると、フレームバッファの内容は圧縮プロ
セッサ１２へ転送される。ここで、圧縮プロセッサ１２
は、例えばシーキューブ社（Ｃ−Ｃｕｂｅ）（サンノ
ゼ、カルフォルニア）の４チップＡＳＩＣ（Ａｐｐｒｉ
ｃａｔｉｏｎ ＳｐｅｃｉｆｉｃＩｎｔｅｇｒａｔｅｄ
Ｃｉｒｃｕｉｔ）セットのような、現在商業的に提供
されている多くのバージョンでもよい。ＪＰＥＧ（Ｊｏ
ｉｎｔ Ｐｈｏｔｏｇｒａｈｉｃ Ｅｘｐｅｒｔｓ Ｇ
ｒｏｕｐ）、すなわちＣＣＩＴＴ（Ｉｎｔｅｒｎａｔｉ
ｏｎａｌ Ｔｅｌｅｇｒａｐｈ ａｎｄ Ｔｅｌｅｐｈ
ｏｎｅ Ｃｏｍｍｉｔｔｅｅ）のサブセットであるＩＳ
Ｏ（Ｉｎｔｅｒｎａｔｉｏｎａｌ Ｓｔａｎｄａｒｄｓ
Ｏｒｇａｎｉｚａｔｉｏｎ）の一部会であり、ここで
まとめられたイメージ圧縮アルゴリズムが、１９８５年
の報告書ＪＴＣ１／ＳＣ２／ＷＧ８で完全に記述されて
いる。圧縮プロセッサ１２では、このイメージ圧縮アル
ゴリズムをデジタル制御部９の制御下で実行しイメージ
のサイズを圧縮する。５０：１まで選択できる多様な圧
縮率はデジタル・イメージフレーム上で実行される。他
の圧縮率は制御パネル２のスイッチ１４Ａと１４Ｂ（図
６（ｄ））を使って、オペレータが選択可能である。そ
れから、制御パネル２のユーザ・スイッチ１７（図６
（ｄ））に対してオペレータが選択した設定によって、
圧縮されたデジタルフレームはＩＢＭ ＰＣ／そのクロ
ーン機（ＧＩＦＦのような）かアップル・マッキントッ
シュ（Ａｐｐｌｅ Ｍａｃｉｎｔｏｓｈ）（ＰＩＣＴII
のような）のいずれかのイメージ・ファイルフォーマッ
トに変換される。そのフォーマット変換が終わると、そ
のファイルは、デジタル制御部９のコマンド下で高密度
（１．４Ｍバイト記憶容量）デイスクドライブ・ユニッ
ト５を制御するデイスク入出力（Ｉ／Ｏ）インターフェ
イス回路１３の一時記憶バッファに書かれる。デイスケ
ット等へのファイル転送に続いて、制御パネル２のフレ
ームカウンタ・デイスプレイ２２は適切な制御信号によ
って修正される。そして、カメラは次のイメージに対す
る同じ処理を行うことが可能となる。電子回路とデイス
クドライブ系に対する電力は、次に"シュート"制御スイ
ッチ６を解放することによって止められる。
【００１８】本発明の好適な実施例に対応して、ユーザ
はイメージを記録する時の様々な解像度の品質レベルを
選択でき、メモリ・デイスケット記録容量の負担次第で
より高いレベルをも選択できる。スイッチ１４Ａと１４
Ｂの設定位置は、例えば特定のデジタル・マークやワー
ドを各々のスイッチ位置に対応させ、電源の立ち上がり
時と実行中に定期的にそのスイッチをセンスすること
で、それらのデジタル・マークやワードを代表させるこ
とができる。図６（ａ）はスイッチ１４Ａと１４Ｂある
いはスイッチ１７と接続するために使う標準論理ＡＮＤ
ゲート回路６０ａと６０ｂを描いており、この回路は各
々のスイッチ位置を指定するための適当な信号を生成
し、また適切な制御信号生成する。Ｈｉｇｈの位置に配
置されるスイッチで高解像度を選ぶと、４〜５面のイメ
ージだけを格納でき、一方Ｍｅｄ．スイッチ位置で中解
像度を選ぶと、おおよそ２５面のイメージを格納でき
る。そして、Ｌｏｗスイッチで低解像度を選ぶと、５０
面までのイメージを一つのデイスケットに格納できる。
また、スイッチ１４Ｂでカラーの代わりに白黒モードを
選択することで、オペレータは追加の記憶容量を得るこ
とができる。それは、記憶は３（１ピクセル当たり１要
素対カラーでは３要素）より大きい因子で増加するから
である。多様なイメージ解像度の組み合わせが可能で、
それはオペレータが異なる解像度と、イメージ信号の獲
得以前に各イメージに対して設定するモードを選択でき
るからである。これは各イメージに対する解像度とモー
ドを含む各イメージフレーム・データ情報信号がメモリ
・デイスケットに書き込まれる時に、適当なやり方でそ
の信号に印をつけるか"タグ付け"することで実現でき、
この一例を図２（ａ）に示す。図２（ａ）では、デイス
ケット５０はトラック５１ａ、５２ｂ、．．．５２ｎを
持つ。トラック５２ｂでは、カラーモードを示している
デジタルビット５４を持つ代表的なイメージファイルの
情報フォーマットを描いたセグメント５３の典型的な部
分が示されている。カラーモードのタグ５４では、もし
スイッチ１４Ｂがカラー位置にあれば、タグ５４は論
理"１"として記録され、逆に、もしビット５４が論理"
０"として記録されると、それはスイッチ１４Ｂの白黒
の位置に対応する。同様に、スイッチ１４Ａに示されて
いるように、オペレータによる低解像度の選択には２進
の"０"を中解像度の選択には２進の"１"を、高解像度の
選択には２進の"２"をメモリ位置５５に記録する。こ
の"タグ付け"のアプローチを組み込むことによって、利
用以前にＰＣに対してロードされるかイメージデータと
共にメモリ記録デイスケットに書き込まれる伸長のアル
ゴリズムが、自動的にイメージファイルに関連した圧縮
の適切なレベルを決定し、効率的に伸長を実行すること
が可能となる。
はイメージを記録する時の様々な解像度の品質レベルを
選択でき、メモリ・デイスケット記録容量の負担次第で
より高いレベルをも選択できる。スイッチ１４Ａと１４
Ｂの設定位置は、例えば特定のデジタル・マークやワー
ドを各々のスイッチ位置に対応させ、電源の立ち上がり
時と実行中に定期的にそのスイッチをセンスすること
で、それらのデジタル・マークやワードを代表させるこ
とができる。図６（ａ）はスイッチ１４Ａと１４Ｂある
いはスイッチ１７と接続するために使う標準論理ＡＮＤ
ゲート回路６０ａと６０ｂを描いており、この回路は各
々のスイッチ位置を指定するための適当な信号を生成
し、また適切な制御信号生成する。Ｈｉｇｈの位置に配
置されるスイッチで高解像度を選ぶと、４〜５面のイメ
ージだけを格納でき、一方Ｍｅｄ．スイッチ位置で中解
像度を選ぶと、おおよそ２５面のイメージを格納でき
る。そして、Ｌｏｗスイッチで低解像度を選ぶと、５０
面までのイメージを一つのデイスケットに格納できる。
また、スイッチ１４Ｂでカラーの代わりに白黒モードを
選択することで、オペレータは追加の記憶容量を得るこ
とができる。それは、記憶は３（１ピクセル当たり１要
素対カラーでは３要素）より大きい因子で増加するから
である。多様なイメージ解像度の組み合わせが可能で、
それはオペレータが異なる解像度と、イメージ信号の獲
得以前に各イメージに対して設定するモードを選択でき
るからである。これは各イメージに対する解像度とモー
ドを含む各イメージフレーム・データ情報信号がメモリ
・デイスケットに書き込まれる時に、適当なやり方でそ
の信号に印をつけるか"タグ付け"することで実現でき、
この一例を図２（ａ）に示す。図２（ａ）では、デイス
ケット５０はトラック５１ａ、５２ｂ、．．．５２ｎを
持つ。トラック５２ｂでは、カラーモードを示している
デジタルビット５４を持つ代表的なイメージファイルの
情報フォーマットを描いたセグメント５３の典型的な部
分が示されている。カラーモードのタグ５４では、もし
スイッチ１４Ｂがカラー位置にあれば、タグ５４は論
理"１"として記録され、逆に、もしビット５４が論理"
０"として記録されると、それはスイッチ１４Ｂの白黒
の位置に対応する。同様に、スイッチ１４Ａに示されて
いるように、オペレータによる低解像度の選択には２進
の"０"を中解像度の選択には２進の"１"を、高解像度の
選択には２進の"２"をメモリ位置５５に記録する。こ
の"タグ付け"のアプローチを組み込むことによって、利
用以前にＰＣに対してロードされるかイメージデータと
共にメモリ記録デイスケットに書き込まれる伸長のアル
ゴリズムが、自動的にイメージファイルに関連した圧縮
の適切なレベルを決定し、効率的に伸長を実行すること
が可能となる。
【００１９】本発明に対応するさらに他の実施例では、
音をデジタイズする音響デジタイザ回路を組み込んでい
る。アップルコンピュータ社製の音楽装置データインタ
ーフェイス（ＭＩＤＩ）アダプタように商業的に利用可
能ないくつかのデジタイザがある。このデジタイザの出
力は、補助的Ｉ／Ｏインターフェイス８０と同様の追加
のＩ／Ｏインターフェイス経由で選択的にＣＰＵ２０
（ＦＩＧ７）に接続されている。各イメージに対応した
音響あるいは音声を記録し、デジタイズし、デイスケッ
ト装置上の有効なトラック上に前述のＦＩＧ２Ａと同じ
方法で格納することができる。本実施例に対応するイメ
ージファイルはデジタイズされた音声ファイル５６（Ｆ
ＩＧ２Ａ）に対応して適切に印を付けられるかタグ付け
される。音響を形成するＰＣで再生するとすぐに、イメ
ージと対応する音声を同時に視聴覚することができる。
音をデジタイズする音響デジタイザ回路を組み込んでい
る。アップルコンピュータ社製の音楽装置データインタ
ーフェイス（ＭＩＤＩ）アダプタように商業的に利用可
能ないくつかのデジタイザがある。このデジタイザの出
力は、補助的Ｉ／Ｏインターフェイス８０と同様の追加
のＩ／Ｏインターフェイス経由で選択的にＣＰＵ２０
（ＦＩＧ７）に接続されている。各イメージに対応した
音響あるいは音声を記録し、デジタイズし、デイスケッ
ト装置上の有効なトラック上に前述のＦＩＧ２Ａと同じ
方法で格納することができる。本実施例に対応するイメ
ージファイルはデジタイズされた音声ファイル５６（Ｆ
ＩＧ２Ａ）に対応して適切に印を付けられるかタグ付け
される。音響を形成するＰＣで再生するとすぐに、イメ
ージと対応する音声を同時に視聴覚することができる。
【００２０】本発明に対応するカメラが、従来の静止イ
メージビデオカメラを上回る大きな有効点は、本発明に
よるカメラが多重のデジタルイメージを半導体メモリに
一時的に高速に格納できることであり、一方、同時にイ
メージ圧縮プロセッサ１２とファイルフォーマッタ・ソ
フトウエア・アルゴリズムとフォーマット化されたファ
イルを格納するデイスクＩ／Ｏインターフェイス１３は
より低速でいっせいに各機能をはたす。この実行能力
は、低電力ＶＬＳＩと高速な半導体メモリデバイス（１
０＆１１ ＦＩＧ．５ＡとＦＩＧ．７Ａ）と結び付いた
効率的な設計によって実現される。
メージビデオカメラを上回る大きな有効点は、本発明に
よるカメラが多重のデジタルイメージを半導体メモリに
一時的に高速に格納できることであり、一方、同時にイ
メージ圧縮プロセッサ１２とファイルフォーマッタ・ソ
フトウエア・アルゴリズムとフォーマット化されたファ
イルを格納するデイスクＩ／Ｏインターフェイス１３は
より低速でいっせいに各機能をはたす。この実行能力
は、低電力ＶＬＳＩと高速な半導体メモリデバイス（１
０＆１１ ＦＩＧ．５ＡとＦＩＧ．７Ａ）と結び付いた
効率的な設計によって実現される。
【００２１】大抵の他の静止イメージビデオと従来フィ
ルムのカメラのように、"シュート"制御６（図６
（ｄ））が完全に押された時、制御パネル２のトリガ信
号を生成するデジタル制御部９はフラッシュ装置１６
（図６（ｄ））に対する制御信号を生成し、主イメージ
に光のフラッシュを放射する。
ルムのカメラのように、"シュート"制御６（図６
（ｄ））が完全に押された時、制御パネル２のトリガ信
号を生成するデジタル制御部９はフラッシュ装置１６
（図６（ｄ））に対する制御信号を生成し、主イメージ
に光のフラッシュを放射する。
【００２２】カメラが初期の操作を実行している間に、
ユーザは始めに、標準の３．５インチか類似の記憶媒体
のようなデイスケットを挿入する。様々なメモリ・デイ
スケットサイズとフォーマットが本発明に適合する。し
かし、３．５インチフォーマットの倍密度（８００Ｋバ
イトの記録）か高密度（１４Ｍバイトの記録）デイスケ
ットがソニー（Ｓｏｎｙ）、マクセル（Ｍａｘｅｌ
ｌ）、バーバテイン（Ｖｅｒｂａｔｉｍ）のような様々
な商業ソースから出されており互いに読むことができ
る。それから、ユーザは所望のＰＣフォーマット（ＩＢ
Ｍ ＰＣ／そのクローン機 やアップルマッキン・トッ
シュ（Ａｐｐｌｅ Ｍａｃｉｎｔｏｓｈ）等）を制御パ
ネル２のスイッチ１７（図６（ｄ））経由で選択しなけ
ればならない。図３に示されているように、電源スイッ
チをオンし、デイスケット５０を挿入した後、デジタル
制御部９は全内部回路と電池とデイスクドライブユニッ
トと制御パネルの自己テストを実行する。何らかのエラ
ーが検出されると、適切なエラー表示デバイスが制御パ
ネル上で発光する。電源オンのシーケンス（図３と図１
２参照）の間、挿入されたデイスケット５０は、制御パ
ネル２（ＩＢＭ／アップル／他）上のフォーマット・ス
イッチ１７によって選択されるフォーマットに調和した
フォーマットになっているかどうか、またデイスケット
上のブートブロックをチェックすることによって有効な
記憶スペースがあるかどうかを調べるために、自動的に
チェックされ、その処理過程はその技術に精通している
人にとっては親しみやすいものであろう。何らかの不都
合が検出された場合、エラー表示デバイスは制御パネル
（例えば、デイスク・フル、アンフォーマット等）上で
発光する。それから、オペレータ・フレーム・カウンタ
・デイスプレイ２２（図６（ｄ））は、指定されたオペ
レータ選択（カラー／白黒）とデイスケットタイプ（倍
対高密度）と容量（一部使用対空デイスケット）を基準
として画面の最大数を示すために修正される。実行中
に、制御パネルから実行の消去モード選択するか、正進
／逆進制御をトグルさせることによって、必要であれ
ば、オペレータは選択的にフレームと記録を消去でき
る。
ユーザは始めに、標準の３．５インチか類似の記憶媒体
のようなデイスケットを挿入する。様々なメモリ・デイ
スケットサイズとフォーマットが本発明に適合する。し
かし、３．５インチフォーマットの倍密度（８００Ｋバ
イトの記録）か高密度（１４Ｍバイトの記録）デイスケ
ットがソニー（Ｓｏｎｙ）、マクセル（Ｍａｘｅｌ
ｌ）、バーバテイン（Ｖｅｒｂａｔｉｍ）のような様々
な商業ソースから出されており互いに読むことができ
る。それから、ユーザは所望のＰＣフォーマット（ＩＢ
Ｍ ＰＣ／そのクローン機 やアップルマッキン・トッ
シュ（Ａｐｐｌｅ Ｍａｃｉｎｔｏｓｈ）等）を制御パ
ネル２のスイッチ１７（図６（ｄ））経由で選択しなけ
ればならない。図３に示されているように、電源スイッ
チをオンし、デイスケット５０を挿入した後、デジタル
制御部９は全内部回路と電池とデイスクドライブユニッ
トと制御パネルの自己テストを実行する。何らかのエラ
ーが検出されると、適切なエラー表示デバイスが制御パ
ネル上で発光する。電源オンのシーケンス（図３と図１
２参照）の間、挿入されたデイスケット５０は、制御パ
ネル２（ＩＢＭ／アップル／他）上のフォーマット・ス
イッチ１７によって選択されるフォーマットに調和した
フォーマットになっているかどうか、またデイスケット
上のブートブロックをチェックすることによって有効な
記憶スペースがあるかどうかを調べるために、自動的に
チェックされ、その処理過程はその技術に精通している
人にとっては親しみやすいものであろう。何らかの不都
合が検出された場合、エラー表示デバイスは制御パネル
（例えば、デイスク・フル、アンフォーマット等）上で
発光する。それから、オペレータ・フレーム・カウンタ
・デイスプレイ２２（図６（ｄ））は、指定されたオペ
レータ選択（カラー／白黒）とデイスケットタイプ（倍
対高密度）と容量（一部使用対空デイスケット）を基準
として画面の最大数を示すために修正される。実行中
に、制御パネルから実行の消去モード選択するか、正進
／逆進制御をトグルさせることによって、必要であれ
ば、オペレータは選択的にフレームと記録を消去でき
る。
【００２３】本発明の好適な実施例の光学系は商業ベー
スの０．５インチ（１／２"）のカラーＣＣＤデバイス
であり、図４に描いたように７８０×４８８のピクセル
・グリッド・アレイを持つ。これは、その技術に精通し
た人に容易に理解でき、商業的に受け入れ可能な解像度
品質のイメージである３８０６４０ピクセル要素であ
る。フォトダイオードのようなカラー映像デバイス（Ｃ
ＣＤアレイ）光電要素で、Ｒ（赤）、Ｇ（緑）、Ｂ
（青）に対するフィルタと共に２次元配列に配置されて
いる。光学的フィルタの様々な配列は周知のことであ
り、本発明では、光学的フィルタの配列は特定の一つに
制限されてはいない。実行中に、各ピクセルは投射する
光量に対応する電荷を格納する。各ピクセルの電荷なＲ
ＧＢ成分はその技術に精通している人におなじみの水平
／垂直アドレス配列を介して連続的に読出される。
スの０．５インチ（１／２"）のカラーＣＣＤデバイス
であり、図４に描いたように７８０×４８８のピクセル
・グリッド・アレイを持つ。これは、その技術に精通し
た人に容易に理解でき、商業的に受け入れ可能な解像度
品質のイメージである３８０６４０ピクセル要素であ
る。フォトダイオードのようなカラー映像デバイス（Ｃ
ＣＤアレイ）光電要素で、Ｒ（赤）、Ｇ（緑）、Ｂ
（青）に対するフィルタと共に２次元配列に配置されて
いる。光学的フィルタの様々な配列は周知のことであ
り、本発明では、光学的フィルタの配列は特定の一つに
制限されてはいない。実行中に、各ピクセルは投射する
光量に対応する電荷を格納する。各ピクセルの電荷なＲ
ＧＢ成分はその技術に精通している人におなじみの水平
／垂直アドレス配列を介して連続的に読出される。
【００２４】図５（ａ）に示すように、アドレスされた
各電荷は増幅され、サンプル＆ホールド回路１８で処理
される。各Ｓ／Ｈ回路でのアナログ電圧は関連するアナ
ログ−デジタル（Ａ／Ｄ）変換器８によってデジタイズ
される。そのデジタル値はピクセルバッファ１０に送ら
れ集められる。このプロセスは、完全なフレームがフレ
ームバッファに集められるまで続く。概略のデジタル論
理とタイミングとこの回路に対する制御信号を図５
（ｂ）に示す。そのタイミングはＣＰＵマイクロプロセ
ッサに不可欠の部分であるマスタ・クロックによって与
えられる。例えば、モトローラの６８０４０マイクロプ
ロセッサは２５ナノ秒（ｎｓｅｃ）周期でおよそ４０メ
ガヘルツ（ＭＨＺ）のクロック速度をもつ。このクロッ
クパルスは、図５（ｂ）に示す、その技術に精通してい
る人におなじみのアドレスと制御信号を生成するファン
クション＆アドレス・デコーダ１９（図６（ｄ））によ
って使用される。多様なマイクロプロセッサのアーキテ
クチャの機能についての技術に精通している人は本発明
の回路を設計できるであろうし、特定の一つのアーキテ
クチャに制限されることはない。Ｓ／Ｈ回路が（ＳＥコ
マンドによって）ピクセル要素（ＰＳコマンドによっ
て）にかけるアナログ電圧を指示する電圧レベルまで充
電されることをタイミングチャートで見ることができ
る。一定期間が経過した後、Ａ／Ｄコンバータは（ＣＥ
コマンドによって）、Ｓ／Ｈのアナログ電圧値の変換を
開始するため動作可能になる。変換が完了するとすぐ
に、変換完了信号（ＣＣ）がＡ／Ｄによって生成され、
Ｓ／Ｈ回路（ファンクション＆アドレス・デコーダ１９
によって生成されるＳＣコマンドによって）に返送さ
れ、次のピクセル要素の変換プロセスを予期して格納さ
れたアナログ電圧を放電する。次に、Ａ／Ｄコンバータ
８の出力はピクセルバッファ１０に（ＰＢコマンドによ
って）記録される。ピクセルバッファ１０がいっぱいに
なる時、フレームバッファ１１に（ＦＢコマンドによっ
て）出力され、ピクセル・マルチプレクサ・アドレス回
路は変換のために次のピクセルを選択する。リセット信
号（ＲＳＴ）は全回路要素に送られ、これらのデバイス
は次のアナログ値の受信前にリセットされる。図５
（ａ）と５Ｂに描かれている本発明の他の新しい概念
は、各ピクセル要素に対するＳ／ＨとＡ／Ｄデバイスを
パラレル化する技術を使って、イメージ信号のアナログ
−デジタル変換処理を加速するものである。これは、従
来の静止イメージビデオ・カメラの設計技術の典型であ
るシリアルのＳ／ＨとＡ／Ｄのパスをなくすことによっ
てなされる。その上、ソニー（Ｓｏｎｙ）、バーブラウ
ン（Ｂｕｒｒ−Ｂｒｏｗｎ）、デーテル（Ｄａｔｅ
ｌ）、アナログデバイセス（ＡｎａｌｏｇＤｅｖｉｃｅ
ｓ）などから出されている高速低電力デバイスは、１５
０ナノ秒（ｎｓｅｃ）より小さいピクセル変換時間を持
ち、Ｓ／ＨとＡ／Ｄ回路の変換スループットの向上を促
進する。例えば、ソニーのビデオＡ／Ｄ変換デバイスＣ
ＸＡ１０１６Ｐ／Ｋは１秒間に５千万サンプルまで、す
なわち変換当たり２０ｎｓｅｃで実行する。このデバイ
スやこのデバイスと類似のものは、本発明の好適な実施
例で利用が可能である。前で説明したように、従来技術
の静止イメージビデオカメラの設計は、各信号成分を共
通／単数のＡ／Ｄパスにマルチプレクスし、信号成分の
数と電力消費を減らす。しかし、本発明のを別の局面か
ら見ると、表面実装技術（ＳＭＤ）のような最小化パッ
ケージ技術とＡＳＩＣ技術にリンクしたＣ−ＭＯＳとＥ
ＣＬデバイスのような構成要素は、これらのデバイスを
並列の設計で合体させることが実現可能になり、消費電
力がほとんど増えることなしに、著しい変換速度の向上
を実現する。従って、この設計アプローチは従来の設計
にたいし大きく変換スループットを向上させる。
各電荷は増幅され、サンプル＆ホールド回路１８で処理
される。各Ｓ／Ｈ回路でのアナログ電圧は関連するアナ
ログ−デジタル（Ａ／Ｄ）変換器８によってデジタイズ
される。そのデジタル値はピクセルバッファ１０に送ら
れ集められる。このプロセスは、完全なフレームがフレ
ームバッファに集められるまで続く。概略のデジタル論
理とタイミングとこの回路に対する制御信号を図５
（ｂ）に示す。そのタイミングはＣＰＵマイクロプロセ
ッサに不可欠の部分であるマスタ・クロックによって与
えられる。例えば、モトローラの６８０４０マイクロプ
ロセッサは２５ナノ秒（ｎｓｅｃ）周期でおよそ４０メ
ガヘルツ（ＭＨＺ）のクロック速度をもつ。このクロッ
クパルスは、図５（ｂ）に示す、その技術に精通してい
る人におなじみのアドレスと制御信号を生成するファン
クション＆アドレス・デコーダ１９（図６（ｄ））によ
って使用される。多様なマイクロプロセッサのアーキテ
クチャの機能についての技術に精通している人は本発明
の回路を設計できるであろうし、特定の一つのアーキテ
クチャに制限されることはない。Ｓ／Ｈ回路が（ＳＥコ
マンドによって）ピクセル要素（ＰＳコマンドによっ
て）にかけるアナログ電圧を指示する電圧レベルまで充
電されることをタイミングチャートで見ることができ
る。一定期間が経過した後、Ａ／Ｄコンバータは（ＣＥ
コマンドによって）、Ｓ／Ｈのアナログ電圧値の変換を
開始するため動作可能になる。変換が完了するとすぐ
に、変換完了信号（ＣＣ）がＡ／Ｄによって生成され、
Ｓ／Ｈ回路（ファンクション＆アドレス・デコーダ１９
によって生成されるＳＣコマンドによって）に返送さ
れ、次のピクセル要素の変換プロセスを予期して格納さ
れたアナログ電圧を放電する。次に、Ａ／Ｄコンバータ
８の出力はピクセルバッファ１０に（ＰＢコマンドによ
って）記録される。ピクセルバッファ１０がいっぱいに
なる時、フレームバッファ１１に（ＦＢコマンドによっ
て）出力され、ピクセル・マルチプレクサ・アドレス回
路は変換のために次のピクセルを選択する。リセット信
号（ＲＳＴ）は全回路要素に送られ、これらのデバイス
は次のアナログ値の受信前にリセットされる。図５
（ａ）と５Ｂに描かれている本発明の他の新しい概念
は、各ピクセル要素に対するＳ／ＨとＡ／Ｄデバイスを
パラレル化する技術を使って、イメージ信号のアナログ
−デジタル変換処理を加速するものである。これは、従
来の静止イメージビデオ・カメラの設計技術の典型であ
るシリアルのＳ／ＨとＡ／Ｄのパスをなくすことによっ
てなされる。その上、ソニー（Ｓｏｎｙ）、バーブラウ
ン（Ｂｕｒｒ−Ｂｒｏｗｎ）、デーテル（Ｄａｔｅ
ｌ）、アナログデバイセス（ＡｎａｌｏｇＤｅｖｉｃｅ
ｓ）などから出されている高速低電力デバイスは、１５
０ナノ秒（ｎｓｅｃ）より小さいピクセル変換時間を持
ち、Ｓ／ＨとＡ／Ｄ回路の変換スループットの向上を促
進する。例えば、ソニーのビデオＡ／Ｄ変換デバイスＣ
ＸＡ１０１６Ｐ／Ｋは１秒間に５千万サンプルまで、す
なわち変換当たり２０ｎｓｅｃで実行する。このデバイ
スやこのデバイスと類似のものは、本発明の好適な実施
例で利用が可能である。前で説明したように、従来技術
の静止イメージビデオカメラの設計は、各信号成分を共
通／単数のＡ／Ｄパスにマルチプレクスし、信号成分の
数と電力消費を減らす。しかし、本発明のを別の局面か
ら見ると、表面実装技術（ＳＭＤ）のような最小化パッ
ケージ技術とＡＳＩＣ技術にリンクしたＣ−ＭＯＳとＥ
ＣＬデバイスのような構成要素は、これらのデバイスを
並列の設計で合体させることが実現可能になり、消費電
力がほとんど増えることなしに、著しい変換速度の向上
を実現する。従って、この設計アプローチは従来の設計
にたいし大きく変換スループットを向上させる。
【００２５】本発明の他の概念による極端な高変換速度
は、別の実施例で高速度カメラの多重の実行を可能にす
る。例えば、本発明の回路（図５（ａ））を用いた前述
のＣＣＤアレイに必要な合計の変換時間は、およそ３８
０，６４０X １５０ｎｓｅｃ、すなわち３８ミリ秒
（ｍｓｅｃ）である。タイミングと制御信号の待ち時間
が、追加の時間（約５ｍｓｅｃ）として必要となる。こ
のように、圧縮処理とメモリ記録デイスケット５０への
記録前に、完全なイメージフレームのための全体の変換
時間は５０ｍｓｅｃより短い。このことにより、およそ
１秒間に２０イメージを取り込むことができる。フレー
ムバッファ１１にＲＡＭ１１Ａ（図１３）や商業ベース
のランダムアクセス・メモリ他の種類を追加することに
よって、イメージフレームを一時的な記憶のための半導
体メモリ・スタックにプッシュすることができ、その半
導体メモリ・スタックによって、圧縮プロセッサとデー
タ・インターフェイス回路がより低速で各々の機能を実
行することを可能としている。図１３で、スタックの待
ち行列中の全イメージが処理され、デイスクＩ／Ｏ回路
１３によって記録デイスケットに書き込まれるまで、各
未処理のイメージフレームは、ファーストイン・ファー
ストアウト（ＦＩＦＯ）で記録されるか、スタックか
ら"とりだされる"。
は、別の実施例で高速度カメラの多重の実行を可能にす
る。例えば、本発明の回路（図５（ａ））を用いた前述
のＣＣＤアレイに必要な合計の変換時間は、およそ３８
０，６４０X １５０ｎｓｅｃ、すなわち３８ミリ秒
（ｍｓｅｃ）である。タイミングと制御信号の待ち時間
が、追加の時間（約５ｍｓｅｃ）として必要となる。こ
のように、圧縮処理とメモリ記録デイスケット５０への
記録前に、完全なイメージフレームのための全体の変換
時間は５０ｍｓｅｃより短い。このことにより、およそ
１秒間に２０イメージを取り込むことができる。フレー
ムバッファ１１にＲＡＭ１１Ａ（図１３）や商業ベース
のランダムアクセス・メモリ他の種類を追加することに
よって、イメージフレームを一時的な記憶のための半導
体メモリ・スタックにプッシュすることができ、その半
導体メモリ・スタックによって、圧縮プロセッサとデー
タ・インターフェイス回路がより低速で各々の機能を実
行することを可能としている。図１３で、スタックの待
ち行列中の全イメージが処理され、デイスクＩ／Ｏ回路
１３によって記録デイスケットに書き込まれるまで、各
未処理のイメージフレームは、ファーストイン・ファー
ストアウト（ＦＩＦＯ）で記録されるか、スタックか
ら"とりだされる"。
【００２６】図６（ｄ）で示したように、制御パネルの
設定はＣＰＵ２０のマイクロプロセッサによってモニタ
され、適切なタイミング、制御、信号処理が厳密になさ
れる。マイクロプロセッサ２０は、その仕様が商業ベー
スで入手でき、それを参照することで具体化に検討でき
るモトラーラ製の６８０４０、インテル製８０３８、ま
たは等価のマイクロプロセッサのどれでもよい。本発明
では、デジタル制御部９の中でマイクロプロセッサを利
用して、双方向のファンクション＆アドレス・デコーダ
１９を経由し、オペレータのスイッチ設定１４Ａ、１４
Ｂ、１７をポーリングすることで、回路ステータス／制
御データとオペレータコマンドの両方の受信するのと同
様に、コマンドとステータスを特定の制御、機能、制御
パネルの表示部へ転送する。このアプローチで、ユーザ
はすぐに、イメージ記録デイスケット５０の中にどのく
らいの記録容量が残っているかを知ることができ、ま
た、ステータス・デイスプレイ２１、２２、２３と、図
３で示すようなバックグランドで進行中のソフトウエア
・自己テストを利用してカメラの全作用と機能のステー
タスを得ることができる。この一例として、ローバッテ
リ状態がある。まず、自己テスト光出力ダイオード２１
（図６（ｄ））が発光し、適切なエラー表示が、ユーザ
に正確なエラーの示度を与えるステータス・デイスプレ
イ２２の中での発光によってなされる。制御アプローチ
の中で、この組み込まれたマイクロプロセッサの作用を
示す別の例はフォーマット・スイッチ１７（図６
（ｄ））である。フォーマット・スイッチ１７の位置
は、カメラに電力が投入された直後のアプリケーション
でセンスされる。デイスケットの挿入に引き続いて、デ
イスケット上のブートブロックはフォーマット・スイッ
チ１７の設定（ＩＢＭ／そのクローン機、またはアップ
ル）と比較され、もし、そのフォーマットが一致しない
か、デイスク５０がフォーマットされていなければ、デ
イスクフォーマット・ステータス・光出力ダイオード２
３が発光し、適切なエラー表示をステータス・デイスプ
レイ２２に表示することで、ユーザに対しエラーを正す
適切な手段をとることを催促する。
設定はＣＰＵ２０のマイクロプロセッサによってモニタ
され、適切なタイミング、制御、信号処理が厳密になさ
れる。マイクロプロセッサ２０は、その仕様が商業ベー
スで入手でき、それを参照することで具体化に検討でき
るモトラーラ製の６８０４０、インテル製８０３８、ま
たは等価のマイクロプロセッサのどれでもよい。本発明
では、デジタル制御部９の中でマイクロプロセッサを利
用して、双方向のファンクション＆アドレス・デコーダ
１９を経由し、オペレータのスイッチ設定１４Ａ、１４
Ｂ、１７をポーリングすることで、回路ステータス／制
御データとオペレータコマンドの両方の受信するのと同
様に、コマンドとステータスを特定の制御、機能、制御
パネルの表示部へ転送する。このアプローチで、ユーザ
はすぐに、イメージ記録デイスケット５０の中にどのく
らいの記録容量が残っているかを知ることができ、ま
た、ステータス・デイスプレイ２１、２２、２３と、図
３で示すようなバックグランドで進行中のソフトウエア
・自己テストを利用してカメラの全作用と機能のステー
タスを得ることができる。この一例として、ローバッテ
リ状態がある。まず、自己テスト光出力ダイオード２１
（図６（ｄ））が発光し、適切なエラー表示が、ユーザ
に正確なエラーの示度を与えるステータス・デイスプレ
イ２２の中での発光によってなされる。制御アプローチ
の中で、この組み込まれたマイクロプロセッサの作用を
示す別の例はフォーマット・スイッチ１７（図６
（ｄ））である。フォーマット・スイッチ１７の位置
は、カメラに電力が投入された直後のアプリケーション
でセンスされる。デイスケットの挿入に引き続いて、デ
イスケット上のブートブロックはフォーマット・スイッ
チ１７の設定（ＩＢＭ／そのクローン機、またはアップ
ル）と比較され、もし、そのフォーマットが一致しない
か、デイスク５０がフォーマットされていなければ、デ
イスクフォーマット・ステータス・光出力ダイオード２
３が発光し、適切なエラー表示をステータス・デイスプ
レイ２２に表示することで、ユーザに対しエラーを正す
適切な手段をとることを催促する。
【００２７】本発明の他の実施例では、補助Ｉ／Ｏイン
ターフェイス回路やポートをデジタル制御部９に追加す
ることに関与する。図７で示されているように、補助的
Ｉ／Ｏポート８０はデイスクＩ／Ｏインターフェイス１
３と同様の方法で接続している。この追加のＩ／Ｏ線
は、外部制御とカメラ内の全タイミングと制御信号のモ
ニタのために備えられている。さらに、イメージデータ
は、圧縮プロセッサをバイパスして、光学デイスク記録
装置、デジタル・アナライザ、または所望の他のデータ
プロセッサのような追加の内部／外部装置に送出される
ことが可能である。
ターフェイス回路やポートをデジタル制御部９に追加す
ることに関与する。図７で示されているように、補助的
Ｉ／Ｏポート８０はデイスクＩ／Ｏインターフェイス１
３と同様の方法で接続している。この追加のＩ／Ｏ線
は、外部制御とカメラ内の全タイミングと制御信号のモ
ニタのために備えられている。さらに、イメージデータ
は、圧縮プロセッサをバイパスして、光学デイスク記録
装置、デジタル・アナライザ、または所望の他のデータ
プロセッサのような追加の内部／外部装置に送出される
ことが可能である。
【００２８】図７はデジタル制御部９を示す。マイクロ
プロセッサ２０のアーキテクチャはその技術に精通して
いる人には代表的なものである。フレームバッファ１１
（図５（ａ））は、イメージデータの完全なフレームが
受信されるまで、ピクセルバッファ１０の出力を受信し
格納する。それから、ソフトウエア制御下のＣＰＵ２０
は、制御信号をシャッタと制御回路１５（図６（ｄ））
の光学論理に送出し、将来のイメージ記録のためのそれ
らの機能をリセットする。ＣＰＵ２０からのコマンドに
従い、いっぱいになったフレームバッファ１１のデータ
を圧縮プロセッサ１２（図２（ｂ））へ転送し、イメー
ジデータに対する数千レベルのパラレル・パイプライン
処理を実行する。それから、圧縮されたイメージフレー
ムは大規模メモリＲＡＭ（ランダムアクセス・メモリ）
２４に書き出され、デイスクＩ／Ｏインターフェイス回
路１３によってデイスクドライブ・アセンブリ５に転送
されるまで、そこで一時的に格納される。
プロセッサ２０のアーキテクチャはその技術に精通して
いる人には代表的なものである。フレームバッファ１１
（図５（ａ））は、イメージデータの完全なフレームが
受信されるまで、ピクセルバッファ１０の出力を受信し
格納する。それから、ソフトウエア制御下のＣＰＵ２０
は、制御信号をシャッタと制御回路１５（図６（ｄ））
の光学論理に送出し、将来のイメージ記録のためのそれ
らの機能をリセットする。ＣＰＵ２０からのコマンドに
従い、いっぱいになったフレームバッファ１１のデータ
を圧縮プロセッサ１２（図２（ｂ））へ転送し、イメー
ジデータに対する数千レベルのパラレル・パイプライン
処理を実行する。それから、圧縮されたイメージフレー
ムは大規模メモリＲＡＭ（ランダムアクセス・メモリ）
２４に書き出され、デイスクＩ／Ｏインターフェイス回
路１３によってデイスクドライブ・アセンブリ５に転送
されるまで、そこで一時的に格納される。
【００２９】図８のフローチャートは、本発明の好適な
実施例による圧縮プロセッサ１２（図２（ｂ））によっ
て実行されるイメージ圧縮過程に関する各ステップを示
す。フレームバッファ１１の出力は、デジタル制御部９
の制御下で、イメージ圧縮プロセッサ１２の入力に転送
される。前述したように、スイッチ１４Ａ（図６
（ｄ））の設定は、ＣＰＵ２０（図７）によって読み込
まれ、所望のイメージ解像度品質を決定する。オペレー
タが選択したスイッチ１４Ａの設定に依存して、ＡＮＤ
ゲート６０ａ−ｂ（図６（ａ））によって生成された唯
一のデジタル・ワードは、スイッチ１４Ａの選択された
位置によってアクテイブにされ、例えばプログラム制御
で適切に対応する圧縮率パラメータを含む所定のデジタ
ルメモリ位置を選択するＣＰＵ２０（図７）によって、
圧縮プロセッサ１２へ送出される。圧縮プロセッサはこ
のコマンド値を使用し、例えば共分散マトリクスのサイ
ズと離散コサイン変換（ＤＣＴ）の変換係数によって生
成された分散を受理する閾値を設定する。次に、デジタ
ル・イメージ信号は、図２（ｂ）、図５、図６（ｄ）に
結び付けて前述されたＲＧＢフォーマットから輝度と色
光度信号に変換される。それから、コサイン変換された
信号は量子化され、その後ハフマン符号化のための処理
がなされる。その後、ハフマン符号化されたイメージ信
号は、様々なＰＣコンパチブルなフォーマット（ＧＩＦ
Ｆ、ＰＩＣＴ２等）へのフォーマット処理を容易にする
一形式にフォーマット化される。さらにイメージ圧縮過
程の理解を深めるには、１９８５年にＩ．Ｅ．Ｅ．Ｅ協
会から出版されたＩ．Ｅ．Ｅ．ＥカタログナンバーＥＨ
０２３１−１、ライブラリ・オブ・コングレス（Ｌｉｂ
ｒａｒｙ ｏｆ Ｃｏｎｇｒｅｓｓ）８５−６０３８４
を参照されたい。
実施例による圧縮プロセッサ１２（図２（ｂ））によっ
て実行されるイメージ圧縮過程に関する各ステップを示
す。フレームバッファ１１の出力は、デジタル制御部９
の制御下で、イメージ圧縮プロセッサ１２の入力に転送
される。前述したように、スイッチ１４Ａ（図６
（ｄ））の設定は、ＣＰＵ２０（図７）によって読み込
まれ、所望のイメージ解像度品質を決定する。オペレー
タが選択したスイッチ１４Ａの設定に依存して、ＡＮＤ
ゲート６０ａ−ｂ（図６（ａ））によって生成された唯
一のデジタル・ワードは、スイッチ１４Ａの選択された
位置によってアクテイブにされ、例えばプログラム制御
で適切に対応する圧縮率パラメータを含む所定のデジタ
ルメモリ位置を選択するＣＰＵ２０（図７）によって、
圧縮プロセッサ１２へ送出される。圧縮プロセッサはこ
のコマンド値を使用し、例えば共分散マトリクスのサイ
ズと離散コサイン変換（ＤＣＴ）の変換係数によって生
成された分散を受理する閾値を設定する。次に、デジタ
ル・イメージ信号は、図２（ｂ）、図５、図６（ｄ）に
結び付けて前述されたＲＧＢフォーマットから輝度と色
光度信号に変換される。それから、コサイン変換された
信号は量子化され、その後ハフマン符号化のための処理
がなされる。その後、ハフマン符号化されたイメージ信
号は、様々なＰＣコンパチブルなフォーマット（ＧＩＦ
Ｆ、ＰＩＣＴ２等）へのフォーマット処理を容易にする
一形式にフォーマット化される。さらにイメージ圧縮過
程の理解を深めるには、１９８５年にＩ．Ｅ．Ｅ．Ｅ協
会から出版されたＩ．Ｅ．Ｅ．ＥカタログナンバーＥＨ
０２３１−１、ライブラリ・オブ・コングレス（Ｌｉｂ
ｒａｒｙ ｏｆ Ｃｏｎｇｒｅｓｓ）８５−６０３８４
を参照されたい。
【００３０】空間符号化と変換符号化という、イメージ
圧縮技術の２つの伝統的クラスの中で、計算の簡単化の
ために、変換符号化技術は十分にこのアプリケーション
のために役にたっている。変換符号化技術はカルフーネ
ン・ロブーエ（Kａｒｈｕｎｅｎ‐Ｌｏｅｖｅ）変換
（ＫＬＴ）、フーリエ、コサイン、サイン、アダマール
を含み、視覚的に良好な再生の忠実度を提供する。ＫＬ
Ｔアルゴリズムは視覚的に最高の再生の忠実性を提供す
るが、極端に大きなマトリクスサイズのため、深刻な計
算論的複雑性がある。高速フーリエ変換（ＦＦＴ）、離
散コサイン変換（ＤＣＴ）、離散サイン変換（ＤＣＴ）
を含むいくつかの他のアルゴリズムは理にかなった視覚
的再生の忠実度を提供し、本発明で計算論的に実行可能
である。ＤＣＴは計算論的な簡単性とパーフォマンスの
ために、好適なアルゴリズムとしてＪＰＥＧによって採
用されている。
圧縮技術の２つの伝統的クラスの中で、計算の簡単化の
ために、変換符号化技術は十分にこのアプリケーション
のために役にたっている。変換符号化技術はカルフーネ
ン・ロブーエ（Kａｒｈｕｎｅｎ‐Ｌｏｅｖｅ）変換
（ＫＬＴ）、フーリエ、コサイン、サイン、アダマール
を含み、視覚的に良好な再生の忠実度を提供する。ＫＬ
Ｔアルゴリズムは視覚的に最高の再生の忠実性を提供す
るが、極端に大きなマトリクスサイズのため、深刻な計
算論的複雑性がある。高速フーリエ変換（ＦＦＴ）、離
散コサイン変換（ＤＣＴ）、離散サイン変換（ＤＣＴ）
を含むいくつかの他のアルゴリズムは理にかなった視覚
的再生の忠実度を提供し、本発明で計算論的に実行可能
である。ＤＣＴは計算論的な簡単性とパーフォマンスの
ために、好適なアルゴリズムとしてＪＰＥＧによって採
用されている。
【００３１】ＪＰＥＧ（ＩＢＭ、ＡＴ＆Ｔ、デジタルイ
クイプメント（Ｄｅｇｉｔａｌ Ｅｑｕｉｐｍｅｎｔ
Ｃｏｒｐ）、インテル（ｉｎｔｅｌ）を含む多くの会社
からの専門家から構成される）の圧縮／伸長スタンダー
ドが、各製造業者が所有する多くのスタンダードがある
ために起こる、イメージと処理装置間の協力作業性の欠
如の問題に対応するため、１９８５年に作られたことに
注目してもらいたい。ＪＰＥＧスタンダードは、７５倍
までか、所望の視覚的再生の忠実度に依存してより大き
い倍率で効率的なイメージの圧縮を提供する。ＪＰＥＧ
スタンダードは、最初ＲＣＡによって開発され、その
後、集積回路の製造業者であるインテルに売られ、現在
インテルが所有するＤＶＩと呼ばれるスタンダードのよ
うな所有のアルゴリズムに取って代わるものとして産業
で広く使われいる。インテルはインテル自身が所有する
１００：１もの度を越した圧縮率を実現するＤＶＩスタ
ンダードを統合したファームウエアの圧縮プロセッサを
提供する。しかし、ＭＰＥＧと呼ばれる新しい国際スタ
ンダードが、１９９１年の枠組みのなかでＪＰＥＧから
アナウンスされることになっており、圧縮率２７５：１
かそれ以上を提供するはずである。本発明の好適な実施
例で、ＪＰＥＧスタンダードは、将来ＭＰＥＧスタンダ
ードや類似のスタンダードを統合と共に、選択される好
適なアルゴリズムである。本発明の他の実施例は、ＤＶ
Ｉのように所有されている多様な圧縮アルゴリズム・ス
タンダードの統合である。
クイプメント（Ｄｅｇｉｔａｌ Ｅｑｕｉｐｍｅｎｔ
Ｃｏｒｐ）、インテル（ｉｎｔｅｌ）を含む多くの会社
からの専門家から構成される）の圧縮／伸長スタンダー
ドが、各製造業者が所有する多くのスタンダードがある
ために起こる、イメージと処理装置間の協力作業性の欠
如の問題に対応するため、１９８５年に作られたことに
注目してもらいたい。ＪＰＥＧスタンダードは、７５倍
までか、所望の視覚的再生の忠実度に依存してより大き
い倍率で効率的なイメージの圧縮を提供する。ＪＰＥＧ
スタンダードは、最初ＲＣＡによって開発され、その
後、集積回路の製造業者であるインテルに売られ、現在
インテルが所有するＤＶＩと呼ばれるスタンダードのよ
うな所有のアルゴリズムに取って代わるものとして産業
で広く使われいる。インテルはインテル自身が所有する
１００：１もの度を越した圧縮率を実現するＤＶＩスタ
ンダードを統合したファームウエアの圧縮プロセッサを
提供する。しかし、ＭＰＥＧと呼ばれる新しい国際スタ
ンダードが、１９９１年の枠組みのなかでＪＰＥＧから
アナウンスされることになっており、圧縮率２７５：１
かそれ以上を提供するはずである。本発明の好適な実施
例で、ＪＰＥＧスタンダードは、将来ＭＰＥＧスタンダ
ードや類似のスタンダードを統合と共に、選択される好
適なアルゴリズムである。本発明の他の実施例は、ＤＶ
Ｉのように所有されている多様な圧縮アルゴリズム・ス
タンダードの統合である。
【００３２】ＪＰＥＧアルゴリズムの圧縮／伸長アルゴ
リズム・ファームウエアの利用が、シーキューブ、エレ
クトロニクス・フォ・イメージング（Ｅｌｅｃｔｒｏｎ
ｉｃｓ ｆｏｒ Ｉｍａｇｉｎｇ）、ストーム・テクノ
ロジ（Ｓｔｏｒｍ Ｔｅｃｈｎｏｌｏｇｙ）、バーブラ
ウン、スペクトラル・イノベーション（Ｓｐｅｃｔｒａ
ｌ Ｉｎｏｖａｔｉｏｎ）、インテル等を含む様々な提
供源から商業ベースで可能である。本発明にこのアルゴ
リズムを利用するには、シーキューブから商業ベースで
出されている集積回路のセットを組み込んでも良い。こ
れらの４チップＡＳＩＣ ＪＰＥＧアルゴリズムは以下
の３つの基本ステップを実行することで利用できる。す
なわち、第１に、イメージを８×８ピクセルの正方形に
分割し、離散コサイン変換（ＤＣＴ）を各正方形領域に
適用し、６４の周波数にたいする値を得る。第２に、こ
れらの周波数は量子化アルゴリズムをとうして、重要で
ない周波数が削除される。第３に、そこで残された値
は、最小のビット長になるように最頻値をエンコードす
るハフマン符号化のスキームで処理される。
リズム・ファームウエアの利用が、シーキューブ、エレ
クトロニクス・フォ・イメージング（Ｅｌｅｃｔｒｏｎ
ｉｃｓ ｆｏｒ Ｉｍａｇｉｎｇ）、ストーム・テクノ
ロジ（Ｓｔｏｒｍ Ｔｅｃｈｎｏｌｏｇｙ）、バーブラ
ウン、スペクトラル・イノベーション（Ｓｐｅｃｔｒａ
ｌ Ｉｎｏｖａｔｉｏｎ）、インテル等を含む様々な提
供源から商業ベースで可能である。本発明にこのアルゴ
リズムを利用するには、シーキューブから商業ベースで
出されている集積回路のセットを組み込んでも良い。こ
れらの４チップＡＳＩＣ ＪＰＥＧアルゴリズムは以下
の３つの基本ステップを実行することで利用できる。す
なわち、第１に、イメージを８×８ピクセルの正方形に
分割し、離散コサイン変換（ＤＣＴ）を各正方形領域に
適用し、６４の周波数にたいする値を得る。第２に、こ
れらの周波数は量子化アルゴリズムをとうして、重要で
ない周波数が削除される。第３に、そこで残された値
は、最小のビット長になるように最頻値をエンコードす
るハフマン符号化のスキームで処理される。
【００３３】ＪＰＥＧアルゴリズムのコンパチブル・ソ
フトウエアは商業的にアラジンシステムズ（Ａｌａｄｄ
ｉｎ Ｓｙｓｔｅｍｓ）、ラデイアス社（Ｒａｄｉｕｓ
Ｉｎｃ）、コダック（Ｋｏｄａｋ）他から出されてお
り、これらを利用できる。
フトウエアは商業的にアラジンシステムズ（Ａｌａｄｄ
ｉｎ Ｓｙｓｔｅｍｓ）、ラデイアス社（Ｒａｄｉｕｓ
Ｉｎｃ）、コダック（Ｋｏｄａｋ）他から出されてお
り、これらを利用できる。
【００３４】この技術に精通した人は、そのスキームの
過程と商業ベースで入手可能なソフトウエアとファーム
ウエア・チップセットに親しめるであろう。本発明はカ
メラの中で入手可能なファームウエア・チップセットと
圧縮のためにＰＣで使うソフトウエアの両方を組み込
む。イメージデータを記録する前に、伸長アルゴリズム
をカメラのデイスケット５０に書き込むことができる。
このことはＰＣのユーザがデイスケット５０をＰＣに入
れ、直接イメージデータを組み込むことを許す。なぜな
ら、ユーザによって選択されたイメージファイルは自動
的にユーザが認識できる形に展開されるからである。そ
のアルゴリズムは未使用トラック５２か図２（ａ）に示
すようなデイスケット上の組み合わせのセクタに書き込
まれる。
過程と商業ベースで入手可能なソフトウエアとファーム
ウエア・チップセットに親しめるであろう。本発明はカ
メラの中で入手可能なファームウエア・チップセットと
圧縮のためにＰＣで使うソフトウエアの両方を組み込
む。イメージデータを記録する前に、伸長アルゴリズム
をカメラのデイスケット５０に書き込むことができる。
このことはＰＣのユーザがデイスケット５０をＰＣに入
れ、直接イメージデータを組み込むことを許す。なぜな
ら、ユーザによって選択されたイメージファイルは自動
的にユーザが認識できる形に展開されるからである。そ
のアルゴリズムは未使用トラック５２か図２（ａ）に示
すようなデイスケット上の組み合わせのセクタに書き込
まれる。
【００３５】他方、展開アルゴリズムは、圧縮されたイ
メージデータを含むデイスケット５０を挿入する前に、
ＰＣにロードされる。後者の実施例で、各代表するイメ
ージのための解像度とモード値５４、５５（図２
（ａ））は、適切に対応する展開アルゴリズムを選択し
活性化させる制御を行うために、デイスケット５０から
読出される。
メージデータを含むデイスケット５０を挿入する前に、
ＰＣにロードされる。後者の実施例で、各代表するイメ
ージのための解像度とモード値５４、５５（図２
（ａ））は、適切に対応する展開アルゴリズムを選択し
活性化させる制御を行うために、デイスケット５０から
読出される。
【００３６】図７に示されているように、イメージ圧縮
プロセッサ１２の出力はＲＡＭメモリ２４に送り出さ
れ、フォーマット・スイッチ１７（図６（ｄ））の設定
によって圧縮されたイメージはＰＩＣＴIIかＧＩＦＦフ
ォーマットに変換される。いろいろなＰＣのために多く
のイメージフォーマットが存在することに気づいてほし
い。ＰＩＣＴかＧＩＦＦはアップルとＩＢＭ ＰＣにほ
とんど共通であるため、ソフトウエア・フォーマット・
ルーチンを変更することによって、他のフォーマットを
容易にそのデザインに組み込むことができるにもかかわ
らず、本発明にとって望ましいフォーマットである。こ
れらソフトウエア・イメージ・フォーマットは商業ベー
スで多くのソースから入手可能で、特にＰＩＣＴに対し
てＩＢＭＰＣ、ＧＩＦＦに対してはアップルが著名であ
る。ＰＩＣＴフォーマットの例は、コンピュータ技術に
精通している人にとって親しめるようになる図６（ｂ）
に示されている。一旦フォーマッテイングが終了する
と、そのフォーマット化されたイメージデータは、磁気
記録デイスケット５０に転送するため、デイスクＩ／Ｏ
インターフェイス１３に転送される。
プロセッサ１２の出力はＲＡＭメモリ２４に送り出さ
れ、フォーマット・スイッチ１７（図６（ｄ））の設定
によって圧縮されたイメージはＰＩＣＴIIかＧＩＦＦフ
ォーマットに変換される。いろいろなＰＣのために多く
のイメージフォーマットが存在することに気づいてほし
い。ＰＩＣＴかＧＩＦＦはアップルとＩＢＭ ＰＣにほ
とんど共通であるため、ソフトウエア・フォーマット・
ルーチンを変更することによって、他のフォーマットを
容易にそのデザインに組み込むことができるにもかかわ
らず、本発明にとって望ましいフォーマットである。こ
れらソフトウエア・イメージ・フォーマットは商業ベー
スで多くのソースから入手可能で、特にＰＩＣＴに対し
てＩＢＭＰＣ、ＧＩＦＦに対してはアップルが著名であ
る。ＰＩＣＴフォーマットの例は、コンピュータ技術に
精通している人にとって親しめるようになる図６（ｂ）
に示されている。一旦フォーマッテイングが終了する
と、そのフォーマット化されたイメージデータは、磁気
記録デイスケット５０に転送するため、デイスクＩ／Ｏ
インターフェイス１３に転送される。
【００３７】図９と図１０は、他の静止イメージビデオ
カメラのフォーマット、例えば２インチのビデオデイス
ケット上で、本発明で選択可能なＰＣコンパチブルデジ
タルフォーマットに変換する本発明の他の局面に対応す
るビデオフォーマット変換デバイスの好適な実施例を描
いている。操作の一般的概念は図１０に示されている。
図９では、変換器４０の各構成部分は図２（ｂ）と図６
（ｄ）に対応する類似の数字で示されており、"４０−"
の接頭辞プラス名称を持つ。そして、その各構成部分
は、図２（ｂ）と図６（ｄ）の上述の各部分と類似の機
能を実行する。図９を再び参照して、変換器４０は、デ
ジタル制御部９と光学処理回路（ピクセル・マルチプレ
クサ７、Ａ／Ｄ８、他１０−１３）を持つデジタル回路
カードの中で使われる同じ構成要素を組み込んでいる。
主な違いは、ＣＣＤアレイ１は入力デイスクドライブ２
５に置き換えられ、例えば、２インチ（２"）のビデオ
・デイスクドライブ・アセンブリとＮＴＳＣビデオフォ
ーマット・デコーダ２６は、前述したような処理を行う
ため、コンポジットビデオ信号をＲＧＢフォーマットに
変換する。
カメラのフォーマット、例えば２インチのビデオデイス
ケット上で、本発明で選択可能なＰＣコンパチブルデジ
タルフォーマットに変換する本発明の他の局面に対応す
るビデオフォーマット変換デバイスの好適な実施例を描
いている。操作の一般的概念は図１０に示されている。
図９では、変換器４０の各構成部分は図２（ｂ）と図６
（ｄ）に対応する類似の数字で示されており、"４０−"
の接頭辞プラス名称を持つ。そして、その各構成部分
は、図２（ｂ）と図６（ｄ）の上述の各部分と類似の機
能を実行する。図９を再び参照して、変換器４０は、デ
ジタル制御部９と光学処理回路（ピクセル・マルチプレ
クサ７、Ａ／Ｄ８、他１０−１３）を持つデジタル回路
カードの中で使われる同じ構成要素を組み込んでいる。
主な違いは、ＣＣＤアレイ１は入力デイスクドライブ２
５に置き換えられ、例えば、２インチ（２"）のビデオ
・デイスクドライブ・アセンブリとＮＴＳＣビデオフォ
ーマット・デコーダ２６は、前述したような処理を行う
ため、コンポジットビデオ信号をＲＧＢフォーマットに
変換する。
【００３８】図１１では、選択入力２７と出力２８、２
９を示す本発明のビデオ・フォーマット変換デバイス４
０の別の実施例を描いている。ここでは、ＮＴＳＣ／Ｐ
ＡＬフォーマットかＲＧＢフォーマットのビデオ信号の
ための入力２７が供給されることを除いて、図９で示す
変換デバイス４０のために使われたものと全く同じ回路
が使われている。この実施例では、ケーブルＴＶ、カム
コーダ（ＣＡＭＣＯＲＤＥＲ）や他のビデオ信号ソース
から出されるビデオ信号がデジタイズされ、ＰＣコンパ
チブルなフォーマットが得られる。また、イメージの記
録前か記録中にイメージ／ビデオ・ソースを見ることを
可能にするために、ビデオ出力ジャック２８が用意され
ている。最後に、通信モデム、大型／小型デイスク・ド
ライブ・アセンブリ、光学デイスク、特殊デイスプレ
イ、シグナルプロセッサ／アナライザのような、他のＰ
Ｃの周辺装置に接続するすることを可能にするために、
データ出力２９が用意されている。標準シリアル、パラ
レル、またはスモール・コンピュータ・スタンダード・
インターフェイス（ＳＣＳＩ）データポートは補助的I
／Ｏインターフェイス８０に接続され、読みだし可能で
ある。
９を示す本発明のビデオ・フォーマット変換デバイス４
０の別の実施例を描いている。ここでは、ＮＴＳＣ／Ｐ
ＡＬフォーマットかＲＧＢフォーマットのビデオ信号の
ための入力２７が供給されることを除いて、図９で示す
変換デバイス４０のために使われたものと全く同じ回路
が使われている。この実施例では、ケーブルＴＶ、カム
コーダ（ＣＡＭＣＯＲＤＥＲ）や他のビデオ信号ソース
から出されるビデオ信号がデジタイズされ、ＰＣコンパ
チブルなフォーマットが得られる。また、イメージの記
録前か記録中にイメージ／ビデオ・ソースを見ることを
可能にするために、ビデオ出力ジャック２８が用意され
ている。最後に、通信モデム、大型／小型デイスク・ド
ライブ・アセンブリ、光学デイスク、特殊デイスプレ
イ、シグナルプロセッサ／アナライザのような、他のＰ
Ｃの周辺装置に接続するすることを可能にするために、
データ出力２９が用意されている。標準シリアル、パラ
レル、またはスモール・コンピュータ・スタンダード・
インターフェイス（ＳＣＳＩ）データポートは補助的I
／Ｏインターフェイス８０に接続され、読みだし可能で
ある。
【００３９】図１２は本発明の実施例の他の形態を描い
おり、フォーマットされていないか、望まれない（例え
ば、スイッチ１７−ＦＩＧの設定に対応しない）ＰＣの
並びでフォーマットされている、挿入されたデイスケッ
ト５０が、本発明の他の局面に対応するカメラで使用で
きるよう自動的にかつ適切にフォーマット化される方法
を示している。この能力は、本発明によって実行するカ
メラでＰＣ上の記録媒体（デイスケット）を使用する前
に、本発明のユーザがそのＰＣ上の記録媒体をフォーマ
ットすることを前もって実行させることができる。図３
を参照して、パワーオンシーケンスの処理過程は、もし
挿入されたデイスケット５０のフォーマットがオペレー
タが選択したフォーマットスイッチ１７に対応しなけれ
ば、異常なデイスケットフォーマットエラーとなる。自
動的デイスケットフォーマット選択によって、デジタル
制御部９のＣＰＵ２０は、その異常なデイスケットフォ
ーマットエラーに応答して、図１２で示すデイスクフォ
ーマット処理過程を初期化する。図２（ｂ）に示すデイ
スケットフォーマット処理過程が終了するとすぐに、図
３で示されるパワーオンシーケンスがステップＢから継
続される。
おり、フォーマットされていないか、望まれない（例え
ば、スイッチ１７−ＦＩＧの設定に対応しない）ＰＣの
並びでフォーマットされている、挿入されたデイスケッ
ト５０が、本発明の他の局面に対応するカメラで使用で
きるよう自動的にかつ適切にフォーマット化される方法
を示している。この能力は、本発明によって実行するカ
メラでＰＣ上の記録媒体（デイスケット）を使用する前
に、本発明のユーザがそのＰＣ上の記録媒体をフォーマ
ットすることを前もって実行させることができる。図３
を参照して、パワーオンシーケンスの処理過程は、もし
挿入されたデイスケット５０のフォーマットがオペレー
タが選択したフォーマットスイッチ１７に対応しなけれ
ば、異常なデイスケットフォーマットエラーとなる。自
動的デイスケットフォーマット選択によって、デジタル
制御部９のＣＰＵ２０は、その異常なデイスケットフォ
ーマットエラーに応答して、図１２で示すデイスクフォ
ーマット処理過程を初期化する。図２（ｂ）に示すデイ
スケットフォーマット処理過程が終了するとすぐに、図
３で示されるパワーオンシーケンスがステップＢから継
続される。
【００４０】図１４（ａ）では、本発明の他の局面に対
応するフォーマット選択論理の回路ブロック図を示す。
図３と図１２に関連して述べられたようなパワーオンシ
ーケンスの間、デジタル制御部９のプロセッサ２０は、
図１４（ｂ）で示されるフローダイヤグラムでより完全
に述べられるような、フォーマット選択スイッチのサン
プル＆テストルーチンを初期化する。スイッチ１７は図
１４（ａ）で示され、アップルＰＣの位置にあり、そし
て論理レベルｖ１が論理ゲートの６０ｃと６０ｄに対す
る入力としてあたえられている。図２（ａ）で示されて
いるように、アップルＰＣフォーマットのためのフォー
マット信号５７は、論理"０"であり、逆にもしフォーマ
ットスイッチ１７がＩＢＭ ＰＣか他のコンピュータの
位置になっていると、そのフォーマット信号とタグ５７
はそれぞれ論理"１"と論理"２"になる。アップルＰＣフ
ォーマットを示す論理"０"に応答して、プロセッサ２０
は、例えば２メガバイトの記録容量をもつランダムアク
セスメモリから成るフォーマットメモリ２０-２の唯一
のメモリ座標ＸＹをアクセスする。オペレータが選択可
能な所定の数のコンピュータアーキテクチャのためのデ
ータフォーマットは、図６（ｂ）で示されているアップ
ルＰＣのためのフォーマットの内容と並びに似ている。
そして、他のオペレータが選択可能なスイッチ１７の位
置によって、図２（ａ）で示される他の唯一のコード５
７を生成し、対応するメモリ２０-２に格納される。プ
ロセッサ２０は、図６（ｂ）に示されているような写真
イメージファイルフォーマットに対応して、図１４
（ｂ）により詳しく示されているフォーマットサブルー
チンを実行し、デイスク入出力インターフェイスユニッ
ト１３のデータメモリアドレスの割付けを行う。このよ
うに、圧縮プロセッサ１２によって生成されるデジタル
ビデオデータ情報信号は、オペレータが選択したスイッ
チ１７の位置で選ばれるフォーマットに適切に変換さ
れ、デイスクドライブ５に格納される。
応するフォーマット選択論理の回路ブロック図を示す。
図３と図１２に関連して述べられたようなパワーオンシ
ーケンスの間、デジタル制御部９のプロセッサ２０は、
図１４（ｂ）で示されるフローダイヤグラムでより完全
に述べられるような、フォーマット選択スイッチのサン
プル＆テストルーチンを初期化する。スイッチ１７は図
１４（ａ）で示され、アップルＰＣの位置にあり、そし
て論理レベルｖ１が論理ゲートの６０ｃと６０ｄに対す
る入力としてあたえられている。図２（ａ）で示されて
いるように、アップルＰＣフォーマットのためのフォー
マット信号５７は、論理"０"であり、逆にもしフォーマ
ットスイッチ１７がＩＢＭ ＰＣか他のコンピュータの
位置になっていると、そのフォーマット信号とタグ５７
はそれぞれ論理"１"と論理"２"になる。アップルＰＣフ
ォーマットを示す論理"０"に応答して、プロセッサ２０
は、例えば２メガバイトの記録容量をもつランダムアク
セスメモリから成るフォーマットメモリ２０-２の唯一
のメモリ座標ＸＹをアクセスする。オペレータが選択可
能な所定の数のコンピュータアーキテクチャのためのデ
ータフォーマットは、図６（ｂ）で示されているアップ
ルＰＣのためのフォーマットの内容と並びに似ている。
そして、他のオペレータが選択可能なスイッチ１７の位
置によって、図２（ａ）で示される他の唯一のコード５
７を生成し、対応するメモリ２０-２に格納される。プ
ロセッサ２０は、図６（ｂ）に示されているような写真
イメージファイルフォーマットに対応して、図１４
（ｂ）により詳しく示されているフォーマットサブルー
チンを実行し、デイスク入出力インターフェイスユニッ
ト１３のデータメモリアドレスの割付けを行う。このよ
うに、圧縮プロセッサ１２によって生成されるデジタル
ビデオデータ情報信号は、オペレータが選択したスイッ
チ１７の位置で選ばれるフォーマットに適切に変換さ
れ、デイスクドライブ５に格納される。
【００４１】その技術に精通した人は、本好適な実施例
に対する代替え、追加、あるいは変更が、次の請求項の
範囲からはずれることなしになされることを認識できる
であろう。
に対する代替え、追加、あるいは変更が、次の請求項の
範囲からはずれることなしになされることを認識できる
であろう。
【図１】従来の電子静止イメージ・カメラの設計ブロッ
ク図である。
ク図である。
【図２】（ａ）は、デジタルメモリ・デイスケット記憶
装置に格納された音声データファイル、データフォーマ
ット・フラグ、圧縮レベル、カラー／白黒モード選択値
の第１の実施例を示す図である。（ｂ）は、本発明の電
子静止イメージ・カメラの全体構造を示す設計ブロック
図である。
装置に格納された音声データファイル、データフォーマ
ット・フラグ、圧縮レベル、カラー／白黒モード選択値
の第１の実施例を示す図である。（ｂ）は、本発明の電
子静止イメージ・カメラの全体構造を示す設計ブロック
図である。
【図３】電源投入後、本発明の１局面に対応する継続的
自己テスト・シーケンスを示すフローチャートである。
自己テスト・シーケンスを示すフローチャートである。
【図４】本発明の１局面に対応して、利用可能な１／２
インチＣＣＤ配列の例を示す図である。
インチＣＣＤ配列の例を示す図である。
【図５】（ａ）は、本発明の１局面に対応する、イメー
ジ信号からデジタル信号変換論理までを示す設計ブロッ
ク図である。（ｂ）は、本発明の１局面に対応する、イ
メージ信号に対するデジタル信号変換論理の論理とタイ
ミングを示す図である。
ジ信号からデジタル信号変換論理までを示す設計ブロッ
ク図である。（ｂ）は、本発明の１局面に対応する、イ
メージ信号に対するデジタル信号変換論理の論理とタイ
ミングを示す図である。
【図６】（ａ）は、本発明の１局面に対応して、利用で
きる制御パネルスイッチと制御のスイッチ論理の一実施
例を示す図である。（ｂ）は、アップルコンピュータ社
（ＡｐｐｌｅＣｏｍｐｕｔｅｒ，Ｉｎｃ）提供の、公表
されたスタンダードベースを基準とするＰＩＣＴイメー
ジ・ファイル・フォーマットの一例を示す図である。
（ｃ）は、遠隔操作を実施する本発明の別の実施例を示
す図である。（ｄ）は、本発明の１局面に対応する、制
御パネル論理の一例を示す図である。
きる制御パネルスイッチと制御のスイッチ論理の一実施
例を示す図である。（ｂ）は、アップルコンピュータ社
（ＡｐｐｌｅＣｏｍｐｕｔｅｒ，Ｉｎｃ）提供の、公表
されたスタンダードベースを基準とするＰＩＣＴイメー
ジ・ファイル・フォーマットの一例を示す図である。
（ｃ）は、遠隔操作を実施する本発明の別の実施例を示
す図である。（ｄ）は、本発明の１局面に対応する、制
御パネル論理の一例を示す図である。
【図７】本発明の１局面に対応する、デジタル制御部を
単純化したブロック図である。
単純化したブロック図である。
【図８】本発明の１局面に対応する、イメージ圧縮アル
ゴリズムのステップを説明するフローチャートである。
ゴリズムのステップを説明するフローチャートである。
【図９】本発明の１局面に対応する、ビデオフォーマッ
ト変換装置のブロック図である。
ト変換装置のブロック図である。
【図１０】本発明の１局面に対応する、変換装置の動作
を説明するブロック図である。
を説明するブロック図である。
【図１１】本発明の別の局面に対応して、追加のビデオ
入力とデータ出力を示すビデオフォーマット変換器の別
の実施例の図である。
入力とデータ出力を示すビデオフォーマット変換器の別
の実施例の図である。
【図１２】本発明の別の実施例であり、選択的なデイス
ケットフォーマット・ユーティリテイのフローチャート
を示す図である。
ケットフォーマット・ユーティリテイのフローチャート
を示す図である。
【図１３】本発明の別の局面に対応する、フレームバッ
ファの別の実施例であり、フレームバッファ・スタック
が多重ショット（ｓｈｏｔ）モードを許容することを示
す図である。
ファの別の実施例であり、フレームバッファ・スタック
が多重ショット（ｓｈｏｔ）モードを許容することを示
す図である。
【図１４】（ａ）は、本発明の１局面に対応する、フォ
ーマット選択論理の本実施例のブロック図である。
（ｂ）は、フォーマット選択論理を実行するステップを
説明するフロー図である。
ーマット選択論理の本実施例のブロック図である。
（ｂ）は、フォーマット選択論理を実行するステップを
説明するフロー図である。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 シコスキー，マシュウ，エイ. アメリカ合衆国 バージニア州 22153, スプリングフィールド，シャディー パー ム ドライブ 7388 (72)発明者 スピースル，ジェリー，エイ. アメリカ合衆国 バージニア州 22180, ビエナ， ハンターズ プレイス 10727 Ｆターム(参考） 5C022 AA13 AA15 AB15 AB40 AB65 AC18 AC32 AC42 AC72 AC73
Claims (1)
- 【請求項１】 デジタルイメージを取得するためのデジ
タルカメラであって、 当該カメラ内部への複数の制御信号を生成するオペレー
タ制御部と、 前記制御信号の外部制御を可能とするとともに、前記デ
ジタルカメラ外部の装置へ前記デジタルイメージを送信
するデジタル入出力インタフェースと、を有することを
特徴とするデジタルカメラ。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US615,848 | 1990-11-20 | ||
| US07/615,848 US5138459A (en) | 1990-11-20 | 1990-11-20 | Electronic still video camera with direct personal computer (pc) compatible digital format output |
Related Parent Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1992502638 Division | 1991-11-20 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2004062416A Division JP3993858B2 (ja) | 1990-11-20 | 2004-03-05 | デジタルカメラ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JP2002325194A true JP2002325194A (ja) | 2002-11-08 |
| JP3741656B2 JP3741656B2 (ja) | 2006-02-01 |
Family
ID=24467057
Family Applications (3)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4502638A Pending JPH06505841A (ja) | 1990-11-20 | 1991-11-20 | パーソナルコンピュータ・コンパチブルなデジタルフォーマット出力を有する電子静止イメージビデオカメラ |
| JP2002067371A Expired - Lifetime JP3741656B2 (ja) | 1990-11-20 | 2002-03-12 | デジタルカメラ |
| JP2004062416A Expired - Lifetime JP3993858B2 (ja) | 1990-11-20 | 2004-03-05 | デジタルカメラ |
Family Applications Before (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4502638A Pending JPH06505841A (ja) | 1990-11-20 | 1991-11-20 | パーソナルコンピュータ・コンパチブルなデジタルフォーマット出力を有する電子静止イメージビデオカメラ |
Family Applications After (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2004062416A Expired - Lifetime JP3993858B2 (ja) | 1990-11-20 | 2004-03-05 | デジタルカメラ |
Country Status (8)
| Country | Link |
|---|---|
| US (7) | US5138459A (ja) |
| EP (1) | EP0558670B1 (ja) |
| JP (3) | JPH06505841A (ja) |
| KR (1) | KR100222359B1 (ja) |
| AU (1) | AU9142291A (ja) |
| CA (1) | CA2095817C (ja) |
| DE (1) | DE69131138T2 (ja) |
| WO (1) | WO1992009169A1 (ja) |
Families Citing this family (233)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP0469852B1 (en) * | 1990-07-31 | 1999-06-23 | Canon Kabushiki Kaisha | Image processing method and apparatus |
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| US5263136A (en) * | 1991-04-30 | 1993-11-16 | Optigraphics Corporation | System for managing tiled images using multiple resolutions |
| DE69229577T2 (de) * | 1991-04-30 | 2000-03-30 | Canon K.K., Tokio/Tokyo | Photographische Kamera die eine Aufzeichnungsvorrichtung enthält |
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| US5661821A (en) * | 1991-11-26 | 1997-08-26 | Pioneer Electronic Corporation | Still image filing system |
| WO1993012613A1 (en) * | 1991-12-13 | 1993-06-24 | Avid Technology, Inc. | Quantization table adjustment |
| JP2987206B2 (ja) * | 1991-12-13 | 1999-12-06 | アヴィッド・テクノロジー・インコーポレーテッド | バッファ及びフレーム索引作成 |
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| US5717496A (en) * | 1992-11-19 | 1998-02-10 | Olympus Optical Co., Ltd. | Electronic imaging apparatus |
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