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KR970016952A - 버스 대 버스 변환을 갖는 정보 처리 시스템 - Google Patents

버스 대 버스 변환을 갖는 정보 처리 시스템 Download PDF

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KR970016952A
KR970016952A KR1019960033403A KR19960033403A KR970016952A KR 970016952 A KR970016952 A KR 970016952A KR 1019960033403 A KR1019960033403 A KR 1019960033403A KR 19960033403 A KR19960033403 A KR 19960033403A KR 970016952 A KR970016952 A KR 970016952A
Authority
KR
South Korea
Prior art keywords
bus
data
address
management unit
processor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Abandoned
Application number
KR1019960033403A
Other languages
English (en)
Inventor
엠. 카이저 존
이. 마우레 워렌
Original Assignee
제프리 엘. 포맨
인터내셔널 비지네스 머신즈 코포레이션
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 제프리 엘. 포맨, 인터내셔널 비지네스 머신즈 코포레이션 filed Critical 제프리 엘. 포맨
Publication of KR970016952A publication Critical patent/KR970016952A/ko
Abandoned legal-status Critical Current

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    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/14—Handling requests for interconnection or transfer
    • G06F13/16—Handling requests for interconnection or transfer for access to memory bus
    • G06F13/1668—Details of memory controller
    • G06F13/1684—Details of memory controller using multiple buses
    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38—Information transfer, e.g. on bus
    • G06F13/40—Bus structure
    • G06F13/4004—Coupling between buses
    • G06F13/4027—Coupling between buses using bus bridges
    • G06F13/405—Coupling between buses using bus bridges where the bridge performs a synchronising function

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  • General Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • Bus Control (AREA)
  • Information Transfer Systems (AREA)
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Abstract

본 발명은 복수의 버스와 복수의 버스 사이를 변환하기 위한 수단을 갖는 정보 처리 시스템에 관한 것이다.
상기 목적을 위해, 본 발명의 정보 처리 시스템은 하나 이상의 프로세싱 유닛, 프로세서 데이타 버스, 메모리 시스템 및 I/O 버스에 접속된 데이타 버스 관리 유닛, 프로세서 어드레스 버스, 메모리 시스템 및 I/O 버스에 접속된 어드레스 관리 유닛 및 하나 이상의 I/O 콘트롤러를 구비하고, 상기 어드레스 및 데이타 관리 유닛은 I/O 버스와 메모리 시스템으로부터 프로세서 버스를 격리시킴으로써, 시스템 성능, 하드웨어 비용 및 확장성을 최적화한다.
따라서, 본 발명은 복잡한 정보 처리 시스템이 최적화된 시스템 성능, 모듈성, 업그레이드성 및 단일 시스템 버스를 갖는 종래 기술의 시스템에 비해 가격 경쟁력을 갖는다.

Description

버스 대 버스 변환을 갖는 정보 처리 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명을 구현하는 정보 처리 시스템의 블럭도.
제2도, 제2A도, 제2B도 및 제2C도는 본 발명에 따른 데이타 관리 장치의 블럭도.
제3도, 제3A도, 제3B도 및 제3C도는 본 발명에 따른 어드레스 관리 장치의 블럭도.

Claims (13)

  1. 정보 처리 시스템에 있어서, 데이타 입력과 출력 및 어드레스 입력과 출력을 갖는 적어도 하나의 프로세서; 각 프로세서의 상기 데이타 입력과 출력에 접속되고, 제1클럭 주파수에서 동작하는 프로세서 데이타 버스; 각 프로세서의 상기 어드레스 입력과 출력에 접속된 프로세서 어드레스 버스; 상기 프로세서 데이타 버스에 접속되고, 상기 프로세서 데이타 버스에/로부터의 데이타 흐름을 제어하기 위한 데이타 관리 유닛(a data management unit), 상기 프로세서 어드레스 버스에 접속되고, 상기 프로세서 어드레스 버스에/로부터의 어드레스 정보를 제어하기 위한 어드레스 관리 유닛(an address management unit); 데이타 I/O이 상기 데이타 관리 유닛에 접속되고, 어드레스 I/O이 상기 어드레스 관리 유닛에 접속된 데이타와 어드레스 입력 및 출력을 갖는 메모리 시스템; 상기 데이타 관리 유닛에 접속된 데이타 라인과 상기 어드레스 관리 유닛에 접속된 어드레스 라인을 가지며 제2클럭 주파수에서 동작하는 I/O 버스; 및 상기 I/O 버스와 적어도 하나의 I/O 장치에 접속된 적어도 하나의 I/O 콘트롤러를 구비하는 것을 특징으로 하는 정보 처리 시스템.
  2. 제1항에 있어서, 상기 프로세서 어드레스 버스는 상기 제1클럭 주파수에서 동작하는 것을 특징으로 하는 정보 처리 시스템.
  3. 제1항에 있어서, 상기 제1클럭 주파수는 상기 제2클럭 주파수에 대해 비동기성인 것을 특징으로 하는 정보 처리 시스템.
  4. 제1버스와 제2버스 사이의 데이타 흐름을 제어하기 위한 데이타 관리 유닛(A data management unit)에 있어서, 상기 제1버스로부터의 데이타 신호, 상기 제2버스로부터의 데이타 신호 및 제어 신호를 버퍼하기 위한 복수의 버퍼 레지스터; 및 상기 제1버스와 상기 제2버스 사이의 데이타 흐름을 제어하기 위한 제어 논리회로를 구비하는 것을 특징으로 하는 데이타 관리 유닛.
  5. 제4항에 있어서, 상기 제1버스는 프로세서 데이타 버스를 구비하고, 상기 제2버스는 I/O 데이타 버스를 구비하는 것을 특징으로 하는 데이타 관리 유닛.
  6. 제4항에 있어서, 상기 제1버스의 동작을 제어하기 위한 제1클럭 신호와 상기 제2버스의 동작을 제어하기 위한 제2클럭 신호를 더 구비하고, 상기 제1클럭 신호는 상기 제2클럭 신호의 주파수와 위상에 관계없는 주파수와 위상에서 실행하는 것을 특징으로 하는 데이타 관리 유닛.
  7. 제1버스와 제2버스 사이의 어드레스 및 데이타 전송을 제어하기 위한 어드레스 관리 유닛(An address management unit)에 있어서, 상기 제1버스로부터의 어드레스 및 커맨드를 디코드하는 수단(means for decoding addresses and commands); 상기 제2버스로부터의 어드레스 및 커맨드를 디코드하는 수단; 상기 제1버스로부터 디코드된 커맨드를 큐하는 수단(means for queuing commands); 상기 제2버스로부터 디코드된 커맨드를 큐하는 수단; 상기 제1버스로 향하는 커맨드를 발생하는 제1커맨드 실행 논리회로(first command execution logic); 상기 제2버스로 향하는 커맨드를 발생하는 제2커맨드 실행 논리회로; 및 상기 제1버스와 상기 제2버스 사이의 데이타 및 어드레스 전송을 제어하기 위한 제어 신호를 발생하는 수단을 구비하는 것을 특징으로 하는 어드레스 관리 유닛.
  8. 제7항에 있어서, 상기 제1버스는 프로세서 버스를 구비하고, 상기 제2버스는 I/O 버스를 구비하는 것을 특징으로 하는 어드레스 관리 유닛.
  9. 제8항에 있어서, 상기 I/O 버스에서 상기 프로세서 버스로의 인터럽트를 큐하는 수단(means for queuing interrupts)를 더 구비하는 것을 특징으로 하는 어드레스 관리 유닛.
  10. 제7항에 있어서, 상기 제1버스의 동작을 제어하기 위한 제1클럭 신호와 상기 제2버스의 동작을 제어하기 위한 제2클럭 신호를 더 구비하고, 상기 제1클럭 신호는 상기 제2클럭 신호의 주파수와 위상에 관계없는 주파수와 위상에서 실행하는 것을 특징으로 하는 어드레스 관리 유닛.
  11. 정보 처리 시스템에서 제1 및 제2버스 사이의 데이타 및 어드레스 정보의 전송을 제어하기 위한 버스 격리 유닛(A bus isolation unit)에 있어서, 상기 제1버스로부터의 데이타 신호, 상기 제2버스로부터의 데이타 신호 및 제어 신호를 버퍼하기 위한 복수의 버퍼 레지스터; 상기 제1버스와 상기 제2버스 사이의 데이타 흐름을 제어하기 위한 제어 논리회로; 상기 제1버스로부터의 어드레스 및 커맨드를 디코드하는 수단(means for decoding addresses and commands); 상기 제2버스로부터의 어드레스 및 커맨드를 디코드하는 수단; 상기 제1버스로부터 디코드된 커맨드를 큐하는 수단(means for queuing commands); 상기 제2버스로부터 디코드된 커맨드를 큐하는 수단; 상기 제1버스로 향하는 커맨드를 발생하는 제1커맨드 실행 논리회로(first command execution logic); 상기 제2버스로 향하는 커맨드를 발행하는 제2커맨드 실행 논리회로; 및 상기 제1버스와 상기 제2버스 사이의 데이타 및 어드레스 전송을 제어하기 위한 제어 신호를 발생하는 수단을 구비하는 것을 특징으로 하는 버스 격리 유닛.
  12. 제11항에 있어서, 상기 제1버스는 프로세서 버스를 구비하고, 상기 제2버스는 I/O버스를 구비하는 것을 특징으로 하는 버스 격리 유닛.
  13. 제11항에 있어서, 상기 제1버스의 동작을 제어하기 위한 제1클럭 신호와 상기 제2버스의 동작을 제어하기 위한 제2클럭 신호를 더 구비하고, 상기 제1클럭 신호는 상기 제2클럭 신호의 주파수와 위상에 관계없는 주파수와 위상에서 실행하는 것을 특징으로 하는 버스 격리 유닛.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019960033403A 1995-09-29 1996-08-12 버스 대 버스 변환을 갖는 정보 처리 시스템 Abandoned KR970016952A (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US08/537,185 US5687329A (en) 1995-09-29 1995-09-29 Information handling system including a data bus management unit, an address management unit for isolating processor buses from I/O and memory
US08/537,185 1995-09-29

Publications (1)

Publication Number Publication Date
KR970016952A true KR970016952A (ko) 1997-04-28

Family

ID=24141578

Family Applications (1)

Application Number Title Priority Date Filing Date
KR1019960033403A Abandoned KR970016952A (ko) 1995-09-29 1996-08-12 버스 대 버스 변환을 갖는 정보 처리 시스템

Country Status (4)

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US (1) US5687329A (ko)
EP (1) EP0766180A2 (ko)
JP (1) JPH0997231A (ko)
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EP0766180A3 (ko) 1997-04-09
EP0766180A2 (en) 1997-04-02
JPH0997231A (ja) 1997-04-08
US5687329A (en) 1997-11-11

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